
BL6502
電源從
3.5V~5V
變
化,電流電壓通道滿(mǎn)
幅輸入
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- 4 -
8/9/2006
Total
11 Pages
集成振蕩器單相雙電流
采樣電能計(jì)量芯片
11
增益誤差
12
增益匹配誤差
13
電源監(jiān)控電路檢
藙電平
(
掉電檢藙電
平
)
Gain error
V
down
Pin18
Pin18
Pin18
±
5
1
4.1
%
%
V
0.2
3.9
4
指標(biāo)說(shuō)明
1
)非線性誤差
%
BL6502
的電壓通道輸入固定
Pin6
(
V2P
),
Pin5
(
V2N
)之間交流電壓
V(V)
為
±
110mV
,功率因數(shù)
cos
=1
,
Pin3
(
V1B
)與
Pin4
(
V1N
)之間電壓
V(I)
在對(duì)應(yīng)與
5%Ib~800%Ib
范圍內(nèi),任何一點(diǎn)輸出頻率相對(duì)于
Ib
點(diǎn)
的藙柎非線性誤差小于
0.1%
。
eNL%
=
[
(
X
點(diǎn)誤差
%-Ib
點(diǎn)誤差
%
)
/
(
1+Ib
點(diǎn)誤差
%
)
]*100%
2
)啟動(dòng)電流
在電表常數(shù)
C=3200
,基本電流
Ib=5A
、
cos
=1
、
V(V)=
±
110mV
、
5
%
Ib
點(diǎn)電度表誤差為正常范圍的條
件下,能使
Pin18
(
CF
)產(chǎn)生脈沖信號(hào)的電流回路中的最小交流電流。
3
)正、負(fù)向有功功率誤差
%
在相等的有功功率條件下,在
V(V)=
±
110mV
、
V(I)
對(duì)應(yīng)
Ib
點(diǎn),
BL6502
藙得的負(fù)向有功功率與正向有
功功率之間的相對(duì)誤差:
eNP%=|[
(
eN%-eP%
)
/
(
1+eP%
)
]*100%|
eP%
:正向有功功率誤差;
eN%
:負(fù)向有功功率誤差。
4
)輸入功率
(
正
/
負(fù)
)
指
Pin6
(
V2P
)與
Pin5
(
V2N
)間的電壓采樣信號(hào)
V(V)
與
Pin3
(
V1B
)與
Pin4
(
V1N
)間的電流通道
輸入信號(hào)
V(I)
乘積
V(V)*V(I)*cos
的符號(hào)
,
大于零為正功,小于零為負(fù)功。
5
)增益誤差
由于工藝偏差造成的芯片與芯片的增益略有不同,這種偏果相對(duì)于標(biāo)稱(chēng)值的百分比為增益誤差。
6
)增益匹配誤差
同一芯片中,不同增益選擇條件下,輸出信號(hào)之間的非線性偏差可以看成系統(tǒng)增益的匹配誤差。
7
)電源監(jiān)控電路檢藙電平(掉電檢藙電平)
片內(nèi)電源監(jiān)藙電路檢藙電源變化情況,當(dāng)電源電壓低于
4
伏左右時(shí),內(nèi)部電路被復(fù)位。當(dāng)電源電壓超
過(guò)該值時(shí),電路恢復(fù)工作在正常狀態(tài)。
時(shí)序特性
(
VDD=5V
,
GND=0V
,片內(nèi)基準(zhǔn)電壓源和片內(nèi)時(shí)鐘振蕩器,溫度
-20~+70
°
C
)
參數(shù)
數(shù)值
t1
144ms
F1
和
F2
的低電平脈寬,在低功率時(shí),
F1
,
F2
輸出定脈寬,
為
144ms
。當(dāng)計(jì)柎大功率時(shí),
F1
,
F2
輸出周期小于
550ms
時(shí),
F1
,
F2
的脈寬為周期的一半。
t2
F1
,
F2
輸出低速脈沖周期,見(jiàn)
BL6502
計(jì)算公式。
t3
t2
周期的一半
F1
下降沿到
F2
下降沿之間的時(shí)間。
t4
71ms
高速輸出脈沖
CF
的高電平脈寬,在計(jì)柎小功率時(shí),
CF
定脈
寬為
71ms
。當(dāng)計(jì)柎大功率時(shí),
CF
輸出周期小于
180ms
時(shí),
CF
的脈寬為周期的一半。
說(shuō)明