參數(shù)資料
型號(hào)： AX500-1FGG484
廠商： Microsemi SoC
文件頁(yè)數(shù)： 3/262頁(yè)
文件大小： 0K
描述： IC FPGA AXCELERATOR 500K 484FBGA
標(biāo)準(zhǔn)包裝： 40
系列： Axcelerator
邏輯元件/單元數(shù)： 5376
RAM 位總計(jì)： 73728
輸入/輸出數(shù)： 317
門數(shù)： 500000
電源電壓： 1.425 V ~ 1.575 V
安裝類型： 表面貼裝
工作溫度： 0°C ~ 70°C
封裝/外殼： 484-BGA
供應(yīng)商設(shè)備封裝： 484-FPBGA（23x23）
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Detailed Specifications
2- 86
R e v i sio n 1 8
Embedded Memory
The AX architecture provides extensive, high-speed memory resources to the user. Each 4,608 bit block
of RAM contains its own embedded FIFO controller, allowing the user to configure each block as either
RAM or FIFO.
To meet the needs of high performance designs, the memory blocks operate in synchronous mode for
both read and write operations. However, the read and write clocks are completely independent, and
each may operate up to and above 500 MHz.
No additional core logic resources are required to cascade the address and data buses when cascading
different RAM blocks. Dedicated routing runs along each column of RAM to facilitate cascading.
The AX memory block includes dedicated FIFO control logic to generate internal addresses and external
flag logic (FULL, EMPTY, AFULL, AEMPTY). Since read and write operations can occur asynchronously
to one another, special control circuitry is included to prevent metastability, overflow, and underflow. A
block diagram of the memory module is illustrated in Figure 2-57.
During RAM operation, read (RA) and write (WA) addresses are sourced by user logic and the FIFO
controller is ignored. In FIFO mode, the internal addresses are generated by the FIFO controller and
routed to the RAM array by internal MUXes. Enables with programmable polarity are provided to create
upper address bits for cascading up to 16 memory blocks. When cascading memory blocks, the bussed
signals WA, WD, WEN, RA, RD, and REN are internally linked to eliminate external routing congestion.
Figure 2-57 Axcelerator Memory Module
RA [K:0]
RD [(N-1):0]
REN
RCLK
WD [(M-1):0]
WA [J:0]
WEN
WCLK
PIPE
RW [2:0]
WW [2:0]
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PDF描述
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AX500-1FGG484M 制造商:Microsemi Corporation 功能描述:FPGA AXCELERATOR 286K GATES 5376 CELLS 763MHZ 0.15UM 1.5V 48 - Trays 制造商:Microsemi Corporation 功能描述:IC FPGA 317 I/O 484FBGA 制造商:Microsemi Corporation 功能描述:IC FPGA AXCELERATOR 500K 484FBGA
AX500-1FGG676 功能描述:IC FPGA AXCELERATOR 500K 676FBGA RoHS:是 類別:集成電路 (IC) >> 嵌入式 - FPGA（現(xiàn)場(chǎng)可編程門陣列） 系列:Axcelerator 產(chǎn)品培訓(xùn)模塊:Three Reasons to Use FPGA's in Industrial Designs Cyclone IV FPGA Family Overview 特色產(chǎn)品:Cyclone? IV FPGAs 標(biāo)準(zhǔn)包裝:60 系列:CYCLONE® IV GX LAB/CLB數(shù):9360 邏輯元件/單元數(shù):149760 RAM 位總計(jì):6635520 輸入/輸出數(shù):270 門數(shù):- 電源電壓:1.16 V ~ 1.24 V 安裝類型:表面貼裝 工作溫度:0°C ~ 85°C 封裝/外殼:484-BGA 供應(yīng)商設(shè)備封裝:484-FBGA（23x23）
AX500-1FGG676I 功能描述:IC FPGA AXCELERATOR 500K 676FBGA RoHS:是 類別:集成電路 (IC) >> 嵌入式 - FPGA（現(xiàn)場(chǎng)可編程門陣列） 系列:Axcelerator 產(chǎn)品培訓(xùn)模塊:Three Reasons to Use FPGA's in Industrial Designs Cyclone IV FPGA Family Overview 特色產(chǎn)品:Cyclone? IV FPGAs 標(biāo)準(zhǔn)包裝:60 系列:CYCLONE® IV GX LAB/CLB數(shù):9360 邏輯元件/單元數(shù):149760 RAM 位總計(jì):6635520 輸入/輸出數(shù):270 門數(shù):- 電源電壓:1.16 V ~ 1.24 V 安裝類型:表面貼裝 工作溫度:0°C ~ 85°C 封裝/外殼:484-BGA 供應(yīng)商設(shè)備封裝:484-FBGA（23x23）
AX500-1FGG676M 制造商:Microsemi Corporation 功能描述:FPGA Axcelerator Family 286K Gates 5376 Cells 763MHz 0.15um Technology 1.5V 676-Pin FBGA 制造商:Microsemi Corporation 功能描述:FPGA AXCELERATOR 286K GATES 5376 CELLS 763MHZ 0.15UM 1.5V 67 - Trays 制造商:Microsemi Corporation 功能描述:IC FPGA 336 I/O 676FBGA 制造商:Microsemi Corporation 功能描述:IC FPGA AXCELERATOR 500K 676FBGA
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