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參數(shù)資料
| 型號： | AX250-2PQ208I |
| 廠商： | Microsemi SoC |
| 文件頁數(shù)： | 21/262頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC FPGA AXCELERATOR 250K 208QFP |
| 標準包裝： | 24 |
| 系列： | Axcelerator |
| 邏輯元件/單元數(shù)： | 2816 |
| RAM 位總計： | 55296 |
| 輸入/輸出數(shù)： | 115 |
| 門數(shù)： | 250000 |
| 電源電壓： | 1.425 V ~ 1.575 V |
| 安裝類型： | 表面貼裝 |
| 工作溫度： | -40°C ~ 85°C |
| 封裝/外殼： | 208-BFQFP |
| 供應(yīng)商設(shè)備封裝： | 208-PQFP（28x28） |
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Axcelerator Family FPGAs
Re vi s i on 18
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Table 2-99 Two FIFO Blocks Cascaded
Worst-Case Commercial Conditions VCCA = 1.425 V, VCCI = 3.0 V, TJ = 70°C
–2 Speed
–1 Speed
Std Speed
Units
Parameter
Description
Min.
Max.
Min.
Max.
Min.
Max.
FIFO Module Timing
tWSU
Write Setup
13.75
15.66
18.41
ns
tWHD
Write Hold
0.00
ns
tWCKH
WCLK High
0.75
ns
tWCKL
WCLK Low
1.76
ns
tWCKP
Minimum WCLK Period
2.51
ns
tRSU
Read Setup
14.33
16.32
19.19
ns
tRHD
Read Hold
0.00
ns
tRCKH
RCLK High
0.73
ns
tRCKL
RCLK Low
1.89
ns
tRCKP
Minimum RCLK period
2.62
ns
tCLRHF
Clear High
0.00
ns
tCLR2FF
Clear-to-flag (EMPTY/FULL)
1.92
2.18
2.57
ns
tCLR2AF
Clear-to-flag (AEMPTY/AFULL)
4.39
5.00
5.88
ns
tCK2FF
Clock-to-flag (EMPTY/FULL)
2.13
2.42
2.85
ns
tCK2AF
Clock-to-flag (AEMPTY/AFULL)
5.04
5.75
6.75
ns
tRCK2RD1
RCLK-To-OUT (Pipelined)
1.43
1.63
1.92
ns
tRCK2RD2
RCLK-To-OUT (Nonpipelined)
2.26
2.58
3.03
ns
Note:
Timing data for these two cascaded FIFO blocks uses a depth of 8,192. For all other combinations, use
Microsemi’s timing software.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| A42MX24-PLG84I | IC FPGA MX SGL CHIP 36K 84-PLCC |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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| AX250-2PQ896B | 制造商:ACTEL 制造商全稱:Actel Corporation 功能描述:Axcelerator Family FPGAs |
| AX250-2PQ896I | 制造商:ACTEL 制造商全稱:Actel Corporation 功能描述:Axcelerator Family FPGAs |
| AX250-2PQ896M | 制造商:ACTEL 制造商全稱:Actel Corporation 功能描述:Axcelerator Family FPGAs |
| AX250-2PQ896PP | 制造商:ACTEL 制造商全稱:Actel Corporation 功能描述:Axcelerator Family FPGAs |
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