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參數(shù)資料
| 型號： | AX125-FGG256 |
| 廠商： | Microsemi SoC |
| 文件頁數(shù)： | 230/262頁 |
| 文件大小： | 0K |
| 描述： | IC FPGA AXCELERATOR 125K 256FBGA |
| 標準包裝： | 90 |
| 系列： | Axcelerator |
| 邏輯元件/單元數(shù)： | 1344 |
| RAM 位總計： | 18432 |
| 輸入/輸出數(shù)： | 138 |
| 門數(shù)： | 125000 |
| 電源電壓： | 1.425 V ~ 1.575 V |
| 安裝類型： | 表面貼裝 |
| 工作溫度： | 0°C ~ 70°C |
| 封裝/外殼： | 256-LBGA |
| 供應商設備封裝： | 256-FPBGA（17x17） |
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Re vi s i on 18
1-1
1 – General Description
Axcelerator devices offer high performance at densities of up to two million equivalent system gates.
Based upon the Microsemi AX architecture, Axcelerator has several system-level features such as
embedded SRAM (with complete FIFO control logic), PLLs, segmentable clocks, chip-wide highway
routing, and carry logic.
Device Architecture
AX architecture, derived from the highly-successful SX-A sea-of-modules architecture, has been
designed for high performance and total logic module utilization (Figure 1-1). Unlike in traditional FPGAs,
the entire floor of the Axcelerator device is covered with a grid of logic modules, with virtually no chip
area lost to interconnect elements or routing.
Programmable Interconnect Element
The Axcelerator family uses a patented metal-to-metal antifuse programmable interconnect element that
resides between the upper two layers of metal (Figure 1-2 on page 1-2). This completely eliminates the
channels of routing and interconnect resources between logic modules (as implemented on traditional
FPGAs) and enables the efficient sea-of-modules architecture. The antifuses are normally open circuit
and, when programmed, form a permanent, passive, low-impedance connection, leading to the fastest
signal propagation in the industry. In addition, the extremely small size of these interconnect elements
gives the Axcelerator family abundant routing resources.
The very nature of Microsemi's nonvolatile antifuse technology provides excellent protection against
design pirating and cloning (FuseLock technology). Typical cloning attempts are impossible (even if the
security fuse is left unprogrammed) as no bitstream or programming file is ever downloaded or stored in
the device. Reverse engineering is virtually impossible due to the difficulty of trying to distinguish
between programmed and unprogrammed antifuses and also due to the programming methodology of
antifuse devices (see "Security" on page 2-108).
Figure 1-1
Sea-of-Modules Comparison
Switch
Matrix
Routing
Logic Block
Logic
Modules
Sea-of-Modules
Architecture
Traditional FPGA
Architecture
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PDF描述 |
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