參數(shù)資料
型號(hào)： ATTINY2313V-8MJ
廠商： ATMEL CORP
元件分類： 微控制器/微處理器
英文描述： -bit AVR Microcontroller with 8K Bytes In- System Programmable Flash
中文描述： 8-BIT, FLASH, 8 MHz, RISC MICROCONTROLLER, PQCC32
封裝： 5 X 5 MM, 1 MM HEIGHT, 0.50 MM PITCH, MO-220VHHD2, MLF-32
文件頁(yè)數(shù)： 1/223頁(yè)
文件大?。?/td> 1791K
代理商： ATTINY2313V-8MJ
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Rev. 2543F–AVR–08/04
Features
Utilizes the AVR
RISC Architecture
AVR – High-performance and Low-power RISC Architecture
– 120 Powerful Instructions – Most Single Clock Cycle Execution
– 32 x 8 General Purpose Working Registers
– Fully Static Operation
– Up to 20 MIPS Throughput at 20 MHz
Data and Non-volatile Program and Data Memories
– 2K Bytes of In-System Self Programmable Flash
Endurance 10,000 Write/Erase Cycles
– 128 Bytes In-System Programmable EEPROM
Endurance: 100,000 Write/Erase Cycles
– 128 Bytes Internal SRAM
– Programming Lock for Flash Program and EEPROM Data Security
Peripheral Features
– One 8-bit Timer/Counter with Separate Prescaler and Compare Mode
– One 16-bit Timer/Counter with Separate Prescaler, Compare and Capture Modes
– Four PWM Channels
– On-chip Analog Comparator
– Programmable Watchdog Timer with On-chip Oscillator
– USI – Universal Serial Interface
– Full Duplex USART
Special Microcontroller Features
– debugWIRE On-chip Debugging
– In-System Programmable via SPI Port
– External and Internal Interrupt Sources
– Low-power Idle, Power-down, and Standby Modes
– Enhanced Power-on Reset Circuit
– Programmable Brown-out Detection Circuit
– Internal Calibrated Oscillator
I/O and Packages
– 18 Programmable I/O Lines
– 20-pin PDIP, 20-pin SOIC, and 32-pin MLF
Operating Voltages
– 1.8 - 5.5V (ATtiny2313V)
– 2.7 - 5.5V (ATtiny2313)
Speed Grades
– ATtiny2313V: 0 - 4 MHz @ 1.8 - 5.5V, 0 - 10 MHz @ 2.7 - 5.5V
– ATtiny2313: 0 - 10 MHz @ 2.7 - 5.5V, 0 - 20 MHz @ 4.5 - 5.5V
Typical Power Consumption
– Active Mode
1 MHz, 1.8V: 230 μA
32 kHz, 1.8V: 20 μA (including oscillator)
– Power-down Mode
< 0.1 μA at 1.8V
8-bit
Microcontroller
with 2K Bytes
In-System
Programmable
Flash
ATtiny2313/V
Preliminary
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