POR AND POR REARM WITH SLOW RISING V
參數(shù)資料
型號： ATMEGA48-15MT
廠商： Atmel
文件頁數(shù)： 111/240頁
文件大小： 0K
描述： MCU AVR 4K FLASH 15MHZ 32-QFN
產(chǎn)品培訓模塊： megaAVR Introduction
標準包裝： 1
系列： AVR® ATmega
核心處理器： AVR
芯體尺寸： 8-位
速度： 16MHz
連通性： I²C，SPI，UART/USART
外圍設備： 欠壓檢測/復位，POR，PWM，WDT
輸入/輸出數(shù)： 23
程序存儲器容量： 4KB（2K x 16）
程序存儲器類型： 閃存
EEPROM 大小： 256 x 8
RAM 容量： 512 x 8
電壓 - 電源 (Vcc/Vdd)： 2.7 V ~ 5.5 V
數(shù)據(jù)轉換器： A/D 8x10b
振蕩器型： 內部
工作溫度： -40°C ~ 85°C
封裝/外殼： 32-VFQFN 裸露焊盤
包裝： 剪切帶 (CT)
其它名稱： ATMEGA48-15MTCT
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2011 Microchip Technology Inc.
Preliminary
DS41455B-page 199
PIC16LF1902/3
FIGURE 21-3:
POR AND POR REARM WITH SLOW RISING VDD
21.1
DC Characteristics: PIC16LF1902/3-I/E (Industrial, Extended)
PIC16LF1902/3
Standard Operating Conditions (unless otherwise stated)
Operating temperature
-40°C
TA +85°C for industrial
-40°C
TA +125°C for extended
Param.
No.
Sym.
Characteristic
Min.
Typ
Max.
Units
Conditions
Supply Voltage
D001
VDD
1.8
—
3.6
V
FOSC
16 MHz:
D002*
VDR
RAM Data Retention Voltage(1)
1.5
—
V
Device in Sleep mode
D002A*
VPOR*
Power-on Reset Release Voltage
1.54
1.64
1.74
V
D002B*
VPORR*
Power-on Reset Rearm Voltage
—
1.7
—
V
Device in Sleep mode
D003
VADFVR
Fixed Voltage Reference Voltage for
ADC, Initial Accuracy
6
7
8
—
4
6
%1.024V, VDD
1.8V, 85°C
1.024V, VDD
1.8V, 125°C
2.048V, VDD
2.5V, 85°C
2.048V, VDD
2.5V, 125°C
D003A
VCDAFVR
Fixed Voltage Reference Voltage for
Comparator and DAC, Initial Accu-
racy
7
8
9
—
5
7
%1.024V, VDD
1.8V, 85°C
1.024V, VDD
1.8V, 125°C
2.048V, VDD
2.5V, 85°C
2.048V, VDD
2.5V, 125°C
D003B
VLCDFVR
Fixed Voltage Reference Voltage for
LCD Bias, Initial Accuracy
9
9.5
—
9
%3.072V, VDD
3.6V, 85°C
3.072V, VDD
3.6V, 125°C
D003C* TCVFVR
Temperature Coefficient, Fixed Volt-
age Reference
—
-130
—
ppm/°C
D003D*
VFVR/
VIN
Line Regulation, Fixed Voltage Ref-
erence
—
0.270
—
%/V
D004*
SVDD
VDD Rise Rate
to ensure internal
Power-on Reset signal
0.05
—
V/ms
for details.
*
These parameters are characterized but not tested.
Data in “Typ” column is at 3.3V, 25°C unless otherwise stated. These parameters are for design guidance only and are not tested.
Note
1:
This is the limit to which VDD can be lowered in Sleep mode without losing RAM data.
VDD
VPOR
VPORR
VSS
NPOR
TPOR(3)
POR REARM
Note
1:
When NPOR is low, the device is held in Reset.
2:
TPOR 1
s typical.
3:
TVLOW 2.7
s typical.
TVLOW(2)
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