CC = 2.4V to 5.5V and" />
參數(shù)資料
型號： AT89LP2052-20XU
廠商： Atmel
文件頁數(shù)： 82/94頁
文件大?。?/td> 0K
描述： IC 8051 MCU FLASH 2K 20TSSOP
產(chǎn)品培訓(xùn)模塊： MCU Product Line Introduction
標(biāo)準(zhǔn)包裝： 74
系列： 89LP
核心處理器： 8051
芯體尺寸： 8-位
速度： 20MHz
連通性： SPI，UART/USART
外圍設(shè)備： 欠壓檢測/復(fù)位，POR，PWM，WDT
輸入/輸出數(shù)： 15
程序存儲器容量： 2KB（2K x 8）
程序存儲器類型： 閃存
RAM 容量： 256 x 8
電壓 - 電源 (Vcc/Vdd)： 2.4 V ~ 5.5 V
振蕩器型： 內(nèi)部
工作溫度： -40°C ~ 85°C
封裝/外殼： 20-TSSOP（0.173"，4.40mm 寬）
包裝： 管件
83
3547J–MICRO–10/09
AT89LP2052/LP4052
Note:
1. The values in this table are valid for V
CC = 2.4V to 5.5V and Load Capacitance = 80 pF.
Figure 24-6. Shift Register Mode Timing Waveforms
24.6
Test Conditions
24.6.1
AC Testing Input/Output Waveforms(1)
Note:
1. AC Inputs during testing are driven at V
CC - 0.5V for a logic “1” and 0.45V for a logic “0”. Timing measurements are made at
VIH min. for a logic “1” and VIL max. for a logic “0”.
24.6.2
Float Waveforms(1)
Note:
1. For timing purposes, a port pin is no longer floating when a 100 mV change from load voltage occurs. A port pin begins to
float when 100 mV change from the loaded VOH/VOL level occurs.
24.5
Serial Port Timing: Shift Register Mode
Table 24-4.
Serial Port Shift Register Timing Parameters
Symbol
Parameter
Variable Oscillator
Units
Min
Max
tXLXL
Serial Port Clock Cycle Time
2tCLCL -15
s
tQVXH
Output Data Setup to Clock Rising Edge
tCLCL -15
ns
t
XHQX
Output Data Hold after Clock Rising Edge
t
CLCL -15
ns
tXHDX
Input Data Hold after Clock Rising Edge
0
ns
tXHDV
Input Data Valid to Clock Rising Edge
15
ns
01
2
3
4
5
6
7
VALID
CLOCK
WRITE TO SBUF
OUTPUT DATA
CLEAR RI
INPUT DATA
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