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參數(shù)資料
| 型號： | AT89C51CC03UA-S3SUM |
| 廠商： | Atmel |
| 文件頁數(shù)： | 142/198頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC 8051 MCU 64K FLASH 52-PLCC |
| 產品培訓模塊： | MCU Product Line Introduction |
| 標準包裝： | 345 |
| 系列： | AT89C CAN |
| 核心處理器： | 8051 |
| 芯體尺寸： | 8-位 |
| 速度： | 40MHz |
| 連通性： | CAN，SPI，UART/USART |
| 外圍設備： | POR，PWM，WDT |
| 輸入/輸出數(shù)： | 36 |
| 程序存儲器容量： | 64KB（64K x 8） |
| 程序存儲器類型： | 閃存 |
| EEPROM 大?。?/td> | 2K x 8 |
| RAM 容量： | 2.25K x 8 |
| 電壓 - 電源 (Vcc/Vdd)： | 3 V ~ 5.5 V |
| 數(shù)據轉換器： | A/D 8x10b |
| 振蕩器型： | 外部 |
| 工作溫度： | -40°C ~ 85°C |
| 封裝/外殼： | 52-LCC（J 形引線） |
| 包裝： | 管件 |
| 產品目錄頁面： | 616 (CN2011-ZH PDF) |
| 配用： | AT89OCD-01-ND - USB EMULATOR FOR AT8XC51 MCU |
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48
AT89C51CC03
4182O–CAN–09/08
Table 16. Programming Spaces
Notes:
1. The sequence 5xh and Axh must be executing without instructions between them
otherwise the programming is not executed (see Flash Status Register)
2. The sequence 5xh and Axh must be executed with the same FMOD0 FMOD1
configuration.
3. Interrupts that may occur during programming time must be disabled to avoid any
spurious exit of the programming mode.
Status of the Flash Memory
The bit FBUSY in FCON register is used to indicate the status of programming.
FBUSY is set when programming is in progress.
The flash programming process is launched the second machine cycle following the
sequence 5xh and Axh in FCON. Thus the FBUSY flag should be read by sofware not
during the insctruction after the 5xh, Axh sequence but the the second instruction after
the 5xh, Axh sequence in FCON (See next example). FBUSY is cleared when the pro-
gramming is completed.
;*F*************************************************************************
;* NAME: launch_prog
;;***************************************************************************
launch_prog:
MOV FCON, #050h
MOV FCON #0A0h ; Flash Write Sequence
NOP
;Required time before reading busy flag
wait_busy:
MOV A,FCON
JB ACC.0,wait_busy
RET
Selecting FM1
The bit ENBOOT in AUXR1 register is used to map FM1 from F800h to FFFFh.
Loading the Column Latches
Any number of data from 1-byte to 128 Bytes can be loaded in the column latches. This
provides the capability to program the whole memory by byte, by page or by any number
of Bytes in a page. Data written in the column latches do not have to be in consecutive
Write to FCON
Operation
FPL3:0
FPS
FMOD1
FMOD0
User
5
X
0
No action
AX
0
Write the column latches in user
space
Extra Row
5
X
0
1
No action
AX
0
1
Write the column latches in extra row
space
Hardware
Security
Byte
5
X
1
0
No action
A
X
1
0
Write the fuse bits space
Reset
Columns
Latches
5
X
1
No action
A
X
1
Reset the column latches
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