參數資料
型號： AT32UC3C2128C-Z2UR
廠商： Atmel
文件頁數： 79/110頁
文件大?。?/td> 0K
描述： IC MCU 32BIT 128K FLASH 64QFN
標準包裝： 1
系列： AVR®32 UC3 C
核心處理器： AVR
芯體尺寸： 32-位
速度： 66MHz
連通性： CAN，以太網，I²C，IrDA，LIN，SPI，UART/USART，USB
外圍設備： 欠壓檢測/復位，DMA，I²S，POR，PWM，WDT
輸入/輸出數： 45
程序存儲器容量： 128KB（128K x 8）
程序存儲器類型： 閃存
RAM 容量： 32K x 8
電壓 - 電源 (Vcc/Vdd)： 3 V ~ 5.5 V
數據轉換器： A/D 11x12b，D/A 2x12b
振蕩器型： 內部
工作溫度： -40°C ~ 85°C
封裝/外殼： 64-VFQFN 裸露焊盤
包裝： 標準包裝
其它名稱： AT32UC3C2128C-Z2URDKR
70
32117DS–AVR-01/12
AT32UC3C
7.9
Timing Characteristics
7.9.1
Startup, Reset, and Wake-up Timing
The startup, reset, and wake-up timings are calculated using the following formula:
Where
and
are found in Table 7-44.
is the delay relative to RCSYS,
is the period of the CPU clock. If another clock source than RCSYS is selected as CPU
clock the startup time of the oscillator,
, must be added to the wake-up time in the
stop, deepstop, and static sleep modes. Please refer to the source for the CPU clock in the
”O(jiān)scillator Characteristics” on page 57 for more details about oscillator startup times.
ttCONST NCPU tCPU
×
+
=
tCONST
NCPU
tCONST
tCPU
tOSCSTART
Table 7-44.
Maximum Reset and Wake-up Timing
Parameter
Measuring
Max
(in s)
Max
Startup time from power-up, using
regulator
VDDIN_5 rising (10 mV/ms)
Time from V
VDDIN_5=0 to the first instruction entering
the decode stage of CPU. VDDCORE is supplied by
the internal regulator.
2600
0
Startup time from reset release
Time from releasing a reset source (except POR,
BOD18, and BOD33) to the first instruction entering
the decode stage of CPU.
1240
0
Wake-up
Idle
From wake-up event to the first instruction entering
the decode stage of the CPU.
019
Frozen
268
209
Standby
268
209
Stop
268+
212
Deepstop
268+
212
Static
268+
212
tCONST
NCPU
tOSCSTART
相關PDF資料
PDF描述
AT32UC3A1128-AUR MCU AVR32 128K FLASH 100TQFP
AT32UC3C2128C-A2UR IC MCU AVR32 128K FLASH 64TQFP
AT32UC3A4128-C1UR IC MCU 128K FLASH 100VFBGA
90327-0310 CONN RECEPT IDT 10POS 1.27MM TIN
90327-3306 CONN RECEPT IDT 6POS 1.27MM GOLD
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參數描述
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