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參數(shù)資料
| 型號(hào)： | AR1100T-I/SO |
| 廠商： | Microchip Technology |
| 文件頁(yè)數(shù)： | 5/17頁(yè) |
| 文件大?。?/td> | 0K |
| 描述： | IC TOUCH SCREEN CTLR 20-SOIC |
| 標(biāo)準(zhǔn)包裝： | 1,600 |
| 系列： | mTouch™ |
| 類型： | 電阻，USB，RS232 |
| 觸摸面板接口： | 4 線，5 線，8 線 |
| 輸入數(shù)/鍵： | 1 TSC |
| 分辨率（位）： | 10，12 b |
| 評(píng)估套件： | 可供 |
| 數(shù)據(jù)接口： | 串行，UART，USB |
| 電壓基準(zhǔn)： | 內(nèi)部 |
| 電源電壓： | 3.3 V ~ 5 V |
| 電流 - 電源： | 25mA |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 20-SOIC（0.295"，7.50mm 寬） |
| 供應(yīng)商設(shè)備封裝： | 20-SOIC |
| 包裝： | 帶卷 (TR) |
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16
COMMERCIALTEMPERATURERANGE
IDT72V70180 3.3V TIME SLOT INTERCHANGE
DIGITAL SWITCH 128 x 128
tALW
ADDRESS
DATA
tADS
tADH
ALE
5716 drw11
tRW
tWW
tCSRW
tALRD
tCSR
tCSW
tDHW
tDHR
tAKH
tDDR
tDSW
tSWD
tALWR
tAKD
AD0-AD7
D8-D15
CS
RD
WR
DTA
Figure 11. Multiplexed Bus Timing (Intel Mode)
AC ELECTRICAL CHARACTERISTICS - MULTIPLEXED BUS TIMING (INTEL)
NOTE:
1. High Impedance is measured by pulling to the appropriate rail with R
L, with timing corrected to cancel time taken to discharge CL.
Symbol
Parameter
Min.
Typ.
Max.
Units
Test Conditions
tALW
ALE Pulse Width
20
ns
tADS
Address Setup from ALE falling
3
ns
tADH
Address Hold from ALE falling
3
ns
tALRD
RD Active after ALE falling
3
ns
tDDR
Data Setup from
DTA LOW on Read
5
ns
CL = 150pF
tCSRW
CS Hold after RD/WR
5ns
tRW
RD Pulse Width (Fast Read)
45
ns
tCSR
CS Setup from RD
0ns
tDHR(1)
Data Hold after
RD
10
20
ns
CL = 150pF, RL = 1K
tWW
WR Pulse Width (Fast Write)
45
ns
tALWR
WR Delay after ALE falling
3
ns
tCSW
CS Setup from WR
0ns
tDSW
Data Setup from
WR (FastWrite)
20
ns
tSWD
Valid Data Delay on Write (Slow Write)
122
ns
tDHW
Data Hold after
WR Inactive
5
ns
tAKD
Acknowledgment Delay:
Reading/WritingRegisters
43/43
ns
CL = 150pF
Reading/Writing Memory
760/750
ns
CL = 150pF
tAKH(1)
Acknowledgment Hold Time
22
ns
CL = 150pF, RL = 1K
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