參數資料
| 型號： | APA075-FGG144I |
| 廠商： | Microsemi SoC |
| 文件頁數： | 81/178頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC FPGA PROASIC+ 75K 144-FBGA |
| 標準包裝： | 160 |
| 系列： | ProASICPLUS |
| RAM 位總計： | 27648 |
| 輸入/輸出數： | 100 |
| 門數： | 75000 |
| 電源電壓： | 2.3 V ~ 2.7 V |
| 安裝類型： | 表面貼裝 |
| 工作溫度： | -40°C ~ 85°C |
| 封裝/外殼： | 144-LBGA |
| 供應商設備封裝： | 144-FPBGA（13x13） |
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ProASICPLUS Flash Family FPGAs
v5.9
4-3
v4.1
(continued)
updated.
were updated.
A note was added to Figure 2-45 FIFO Reset.
A note was added to Table 2-68 TJ = 0°C to 110°C; VDD = 2.3 V to 2.7 V for Commercial/
The "TRST Test Reset Input" section was updated in the "Pin Description" section.
The "624-Pin CCGA/LGA" section was updated for the APA600 and APA1000. Please review all
pin data.
v4.0
Figure 2-17 Using the PLL for Clock Deskewing was updated.
Table 2-48 Recommended Operating Conditions was updated.
The "1152-Pin FBGA" figure was updated.
Pin names were changed to more accurately reflect the multiple functions supported by each
pin.
v3.5
The ProASICPLUS and ProASICPLUS Military/Aerospace datasheets were combined. This
document now supports Commercial, Industrial, and Military Temperature devices.
Table 1 ProASICPLUS Product Profile was updated.
The "Ordering Information" section was updated.
"Plastic Device Resources" table was updated.
ii
The Long Term Jitter Peak-to-Peak Max. in the "PLL Electrical Specifications" table was updated.
The "Calculating Typical Power Dissipation" section was updated.
Table 2-21 Recommended Operating Conditions was updated.
Table 2-48 Recommended Operating Conditions was updated.
v3.4
The "Temperature Grade Offerings" table is new.
The "Speed Grade and Temperature Matrix" table is new.
The "ProASICPLUS Clock Management System" section was updated.
The "Lock Signal" section was updated.
The "PLL Electrical Specifications" table was updated.
The "User Security" section was updated.
The "Design Environment" section was updated.
Table 2-16 Package Thermal Characteristics was updated.
The "Asynchronous FIFO Full and Empty Transitions" section was updated.
The "AVDD PLL Power Supply" section in the "Pin Description" section was updated.
v3.3
The "144-Pin TQFP" table was updated. The following pins changed:
Pin 15 = GLMX1
Pin 16 = GL1
Pin 21 = GL2
Pin 88 = GL3
Pin93 = GL4
Pin 94 = GLMX2
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Changes in current version (v5.9)
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相關PDF資料 |
PDF描述 |
|---|---|
| APA075-FG144I | IC FPGA PROASIC+ 75K 144-FBGA |
| M1AGL600V5-FGG256 | IC FPGA 1KB FLASH 600K 256-FBGA |
| AGL600V5-FG256 | IC FPGA 1KB FLASH 600K 256-FBGA |
| M1AGL600V5-FG256 | IC FPGA 1KB FLASH 600K 256-FBGA |
| AGL600V5-FGG256 | IC FPGA 1KB FLASH 600K 256-FBGA |
相關代理商/技術參數 |
參數描述 |
|---|---|
| APA075-FGGB | 制造商:ACTEL 制造商全稱:Actel Corporation 功能描述:ProASIC Flash Family FPGAs |
| APA075-FGGES | 制造商:ACTEL 制造商全稱:Actel Corporation 功能描述:ProASIC Flash Family FPGAs |
| APA075-FGGI | 制造商:ACTEL 制造商全稱:Actel Corporation 功能描述:ProASIC Flash Family FPGAs |
| APA075-FGGM | 制造商:ACTEL 制造商全稱:Actel Corporation 功能描述:ProASIC Flash Family FPGAs |
| APA075-FGGPP | 制造商:ACTEL 制造商全稱:Actel Corporation 功能描述:ProASIC Flash Family FPGAs |
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