參數(shù)資料
型號： AMD-756
廠商： ADVANCED MICRO DEVICES INC
元件分類： 總線控制器
英文描述： Peripheral Bus Controller(外圍總線控制器)
中文描述： UNIVERSAL SERIAL BUS CONTROLLER, PBGA272
封裝： PLASTIC, BGA-272
文件頁數(shù)： 363/368頁
文件大?。?/td> 5363K
代理商： AMD-756
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Index
I-1
22548B/0
—
August 1999
AMD-756
Peripheral Bus Controller Data Sheet
Preliminary Information
A
A20M# . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .58
,
329
Absolute Ratings. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 293
AD Bus . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 64
,
66
,
85
,
96
Address Generation, DMA. . . . . . . . . . . . . . . . . . . . . . . . . . . 94
AEN . . . . . . . . . . . . . . . . 29
,
79
,
308
,
310
,
315
,
317
,
319
,
328
AGND . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 62
APICCS# . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .18
,
35
APM . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .13
,
223
Arbiter, IDE. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 12
Arbitration, PCI Bus. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 83
Asserted. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 17
AVDD . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 62
B
Back-to-Back Cycles . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 77
BALE . . . . . . . . . . . . . . . . . . . . 29
,
72
,
79
,
306
,
308
,
310
,
328
Base Class Code (Function 1) . . . . . . . . . . . . . . .263
,
278
–
281
Base Class Code, Function 3 . . . . . . . . . . . . . . . . . . . .225
,
272
BCLK . . . . . . . . . . . . . . . . . . 29
,
69
,
89
,
91
,
98
,
105
,
305
,
328
Block Diagram, AMD-645 Peripheral Bus Controller . . . . . 14
Bus Arbitration, PCI. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 83
Bus Master IDE Register I/O Location . . . . . . . . . . . . . . . . . 83
Bus Master Initiated Cycles, ISA . . . . . . . . . . . . . . . . . . . . . 80
Bus Master Reload (BMS_RLD) . . . . . . . . . . . . . . . . . . . . . 245
Bus Master Status (BM_STS). . . . . . . . . . . . . . . . . . . . . . . . 243
Bus Master, Function 1. . . . . . . . . . . . . . . . . . . . . . . . . . . . . 270
C
C/BE[3:0]# . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 22
,
74
,
302
Channel Mapping Registers, DMA . . . . . . . . . . . . . . . . . . . . 98
Clock Generation . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 88
CMOS/RTC Registers . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 197
Command Register. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 102
Command Register, Function 3 . . . . . . . . . . . . . . . . . .224
,
270
Configuration Read/Write . . . . . . . . . . . . . . . . . . . . . . . . . . . 75
Configuration Registers
AGP Virtual Address Space. 238
–
241
,
260
,
263
,
278
–
281
,
285
–
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 289
Base Address Register 1. . . . . . . . . . . . . . . . . . . . . . . . . . 272
Base Class Code, Function 3 . . . . . . . . . . . . . . . . . .225
,
272
Command Register, Function 3. . . . . . . . . . . . . . . .224
,
270
Device ID, Function 3. . . . . . . . . . . . . . . . . . . . . . . .224
,
270
General Configuration . . . . . . . . . . . . . . . . . . . . . . . . . . . 225
General Purpose SCI Enable . . . . . . . . . . . . . . . . . . . . . . 249
General Purpose SMI Enable . . . . 250
,
252
–
253
,
255
–
256
General Purpose Status (GP_STS) . . . . . . . . . . . . . . . . . 248
GPI Port Input Value (GPI_VAL) .274
,
276
–
278
,
280
–
281
,
283
GPIO Direction Control (GPIO_DIR) . . . . . . . . . . . . . . . 260
GPIO Port Output Value (GPIO_VAL) . 268
–
269
,
275
–
276
,
285
GPO Port Output Value (GPO_VAL). . . . . . . . . . . . 265
–
269
Header Type, Function 3 . . . . . . . . . . . . . . . . .225
,
272
–
273
I/O Register Base Address . . . . . . . . . . . . . . . . . . . . . . . . 230
Latency Timer, Function 3. . . . . . . . . . . . . . . . . . . .225
,
272
Master Interrupt Controller . . . . . . . . . . . . . . . . . . . . . . 194
Power Management Control . . . . . . . . . . . . . . . . . . . . . . 245
Power Management Enable . . . . . . . . . . . . . . . . . . . . . . . 244
Power Management Status. . . . . . . . . . . . . . . . . . . .239
,
243
Power Management Timer . . . . . . . . . . . . . . . . . . . . . . . 246
Primary Activity Detect Enable. . . . . . . . . . . 257
–
258
,
282
Primary Activity Detect Status . . . . . . . . . . . . . . . . . . . 257
Primary Interrupt Channel. . . . . . . . . . . . . . . . . . . . . . . 227
Processor Control. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 247
Processor Level 3 (P_LVL3) . . . . . . . . . . . . . . . . . . . . . . 248
Programming Interface, Function 3. . . . . . . . . . . . 224
,
271
Revision ID, Function 3. . . . . . . . . . . . . . . . . . . . . . 224
,
271
SCI Interrupt . . . . . . . . . . . . . . . . . . . . . . . . . . 226
,
231
–
233
Secondary Channel PRD Table Address . . . . . . . . . . . . 223
Secondary Interrupt Channel. . . . . . . . . . . . . . . . . . . . . 228
Slave Interrupt Controller . . . . . . . . . . . . . . . . . . . . . . . 194
SMI Command (SMI_CMD) . . . . . . . . . . . . . . . . . . . . . . 256
Status
Function 0. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 271
Status, Function 3 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 224
Sub Class Code, Function 3 . . . . . . . . . . . . . . . . . . 225
,
272
Vendor ID, Function 3 . . . . . . . . . . . . . . . . . . . . . . . 224
,
270
CPU Interface
APICCS#. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 18
,
35
CPURST . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 18
,
329
FERR#. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 18
,
329
IGNNE#. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 19
,
329
INIT. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 19
,
162
INTR . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 19
,
247
–
248
,
329
NMI . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 20
,
30
,
159
Signals. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 17
SMI# . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 20
–
21
,
329
STPCLK# . . . . . . . . . . . . . . . . . . . . . . . . . . 21
,
247
–
248
,
329
CPURST . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 18
,
329
D
DA[2:0] . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 38
,
321
DACK#. . . . . . . . . . . . . . . . . 78
,
93
,
98
–
99
,
314
–
315
,
317
,
319
DC Characteristics. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 294
DD[15:0] . . . . . . . . . . . . . . . . . . . . . . . 39
–
40
,
42
–
45
,
321
,
323
DDACKA#. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 40
DDACKB# . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 41
DDMARDYA#. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 41
,
328
DDMARDYB#. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 41
DDRQA . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 40
–
41
,
328
DDRQB . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 41
–
42
,
328
Decoding, Subtractive . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 77
Device ID, Function 3 . . . . . . . . . . . . . . . . . . . . . . . . . 224
,
270
DEVSEL# . . . . . . . . . 9
–
10
,
23
,
28
,
75
,
84
–
87
,
271
,
302
,
328
DIORA#. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 42
,
328
DIORB#. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 42
,
328
DIOWA# . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 42
,
328
DIOWB# . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 43
,
328
Direct Memory Access. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 91
Distributed DMA Control . . . . . . . . . . . . . . . . . . . . . . . . . . 212
Distributed DMA Support. . . . . . . . . . . . . . . . . . . . . . . . . . 100
DMA
Address Generation. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 94
Addressing . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 103
Channel Mapping Registers . . . . . . . . . . . . . . . . . . . . . . . 98
Control Registers. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 102
Controller I/O Registers . . . . . . . . . . . . . . . . . . . . . . . . . 192
Controller Registers . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 91
Controllers . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 91
DACK#. . . . . . . . . . . . . . . 78
,
93
,
98
–
99
,
314
–
315
,
317
,
319
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