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參數(shù)資料
| 型號： | AK5701 |
| 廠商： | Asahi Kasei Microsystems Co.,Ltd |
| 英文描述： | digital audio 16bit A/D converter |
| 中文描述： | 數(shù)字音頻16位A / D轉(zhuǎn)換器 |
| 文件頁數(shù)： | 3/40頁 |
| 文件大?。?/td> | 436K |
| 代理商： | AK5701 |
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ASAHI KASEI
[AKD5701-A]
<KM076904>
2006 / 06
- 3 -
(1) Evaluation of PLL, Master Mode (Default)
Connect PORT2 DSP1 with DSP.
Figure below shows PORT2 pin assign.
a) Set up jumper pins of MCKI clock
When using X’tal as MCKI clock, X’tal of 11.2896MHz, 12MHz, 12.288MHz, 13MHz, 24MHz or 27MHz can
be set to X1. X’tal of 11.2896MHz (Default) is set on the AKD5701-A.
When an external clock (11.2896MHz, 12MHz, 12.288MHz, 13MHz, 24MHz or 27MHz) is supplied through
an RCA connector (J3: EXT/BCLK), select EXTCLK/BCLK on JP16 (XTI) and select EXTCLK/BCLK on
JP19 (MCLK_SEL). JP14 (EXT1) and R20 should be properly selected in order to match the output impedance
of the clock generator.
JP16
XTI
MCLK_SEL
PORT2
GND
GND
NC
NC
NC
VD
SDTO
LRCK
BCLK
MCKO
b) Set up jumper pins of BCLK clock
Output frequency (32fs/64fs) of BCLK should be set by “BCKO1-0 bit” in the AK5701.
There is no necessity for set up JP12.
JP17
BCLK_SEL
JP19
MCKI
JP11
MKFS
EXTCLK
/BCLK
5701-
MCKO
EXTCLK
/BCLK
4114-
MCKO
256fs 512fs1024fs MCKO
c) Set up jumper pins of LRCK clock
JP12
BCLK
32fs 16fs
64fs
EXT
BCLK/
DIT
EXTBCLK/
DIT
EXT
BCLK
JP13
LRCK
1fs
2fs
EXT
JP18
LRCK_SEL
LRCK/
DIT
EXTLRCK/
DIT
EXT
LRCK
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