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參數(shù)資料
| 型號： | AGLN060V5-ZVQG100I |
| 廠商： | Microsemi SoC |
| 文件頁數(shù)： | 84/150頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC FPGA NANO 1KB 60K 100VQFP |
| 標(biāo)準(zhǔn)包裝： | 90 |
| 系列： | IGLOO nano |
| 邏輯元件/單元數(shù)： | 1536 |
| RAM 位總計： | 18432 |
| 輸入/輸出數(shù)： | 71 |
| 門數(shù)： | 60000 |
| 電源電壓： | 1.425 V ~ 1.575 V |
| 安裝類型： | 表面貼裝 |
| 工作溫度： | -40°C ~ 85°C |
| 封裝/外殼： | 100-TQFP |
| 供應(yīng)商設(shè)備封裝： | 100-VQFP（14x14） |
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IGLOO nano Low Power Flash FPGAs
Revision 17
2-23
Detailed I/O DC Characteristics
Table 2-27 Input Capacitance
Symbol
Definition
Conditions
Min.
Max.
Units
CIN
Input capacitance
VIN = 0, f = 1.0 MHz
8
pF
CINCLK
Input capacitance on the clock pin
VIN = 0, f = 1.0 MHz
8
pF
Table 2-28 I/O Output Buffer Maximum Resistances 1
Standard
Drive Strength
RPULL-DOWN
(
)2
RPULL-UP
(
)3
3.3 V LVTTL / 3.3V LVCMOS
2 mA
100
300
4 mA
100
300
6 mA
50
150
8 mA
50
150
3.3 V LVCMOS Wide Range
100 A
Same as equivalent software default drive
2.5 V LVCMOS
2 mA
100
200
4 mA
100
200
6 mA
50
100
8 mA
50
100
1.8 V LVCMOS
2 mA
200
225
4 mA
100
112
1.5 V LVCMOS
2 mA
200
224
1.2 V LVCMOS 4
1 mA
315
1.2 V LVCMOS Wide Range 4
100 A
315
Notes:
1. These maximum values are provided for informational reasons only. Minimum output buffer resistance values depend
on VCCI, drive strength selection, temperature, and process. For board design considerations and detailed output buffer
resistances, use the corresponding IBIS models posted at http://www.microsemi.com/soc/download/ibis/default.aspx.
2. R(PULL-DOWN-MAX) = (VOLspec) / IOLspec
3. R(PULL-UP-MAX) = (VCCImax – VOHspec) / IOHspec
4. Applicable to IGLOO nano V2 devices operating at VCCI
VCC.
相關(guān)PDF資料 |
PDF描述 |
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| AGLN125V2-CSG81I | 功能描述:IC FPGA NANO 1KB 125K 81-CSP RoHS:是 類別:集成電路 (IC) >> 嵌入式 - FPGA（現(xiàn)場可編程門陣列） 系列:IGLOO nano 標(biāo)準(zhǔn)包裝:152 系列:IGLOO PLUS LAB/CLB數(shù):- 邏輯元件/單元數(shù):792 RAM 位總計:- 輸入/輸出數(shù):120 門數(shù):30000 電源電壓:1.14 V ~ 1.575 V 安裝類型:表面貼裝 工作溫度:-40°C ~ 85°C 封裝/外殼:289-TFBGA，CSBGA 供應(yīng)商設(shè)備封裝:289-CSP（14x14） |
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