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參數(shù)資料
| 型號(hào)： | ADV7391 |
| 廠商： | Analog Devices, Inc. |
| 英文描述： | Low Power, Chip Scale 10-Bit SD/HD Video Encoder |
| 中文描述： | 低功耗，芯片尺寸10位標(biāo)清/高清視頻編碼器 |
| 文件頁數(shù)： | 5/96頁 |
| 文件大?。?/td> | 1209K |
| 代理商： | ADV7391 |
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ADV7390/ADV7391/ADV7392/ADV7393
SPECIFICATIONS
POWER SUPPLY SPECIFICATIONS
All specifications T
MIN
to T
MAX
(40°C to +85°C), unless otherwise noted.
Rev. 0 | Page 5 of 96
Table 2.
Parameter
SUPPLY VOLTAGES
V
DD
V
DD_IO
PV
DD
V
AA
POWER SUPPLY REJECTION RATIO
INPUT CLOCK SPECIFICATIONS
V
DD
= 1.71 V to 1.89 V, PV
DD
= 1.71 V to 1.89 V, V
AA
= 2.6 V to 3.465 V, V
DD_IO
= 2.97 V to 3.63 V.
All specifications T
MIN
to T
MAX
(40°C to +85°C), unless otherwise noted.
Conditions
Min
1.71
2.97
1.71
2.6
Typ
1.8
3.3
1.8
3.3
0.002
Max
1.89
3.63
1.89
3.465
Unit
V
V
V
V
%/%
Table 3.
Parameter
f
CLKIN
CLKIN High Time, t
9
CLKIN Low Time, t
10
CLKIN Peak-to-Peak Jitter Tolerance
1
SD = standard definition, ED = enhanced definition (525p/625p), HD = high definition.
ANALOG OUTPUT SPECIFICATIONS
V
DD
= 1.71 V to 1.89 V, PV
DD
= 1.71 V to 1.89 V, V
AA
= 2.6 V to 3.465 V, V
DD_IO
= 2.97 V to 3.63 V.
All specifications T
MIN
to T
MAX
(40°C to +85°C), unless otherwise noted.
Conditions
1
SD/ED
ED (at 54 MHz)
HD
Min
40
40
Typ
27
54
74.25
2
Max
Unit
MHz
MHz
MHz
% of one clock cycle
% of one clock cycle
±ns
Table 4.
Parameter
Full-Drive Output Current
Low Drive Output Current
DAC-to-DAC Matching
Output Compliance, V
OC
Output Capacitance, C
OUT
Analog Output Delay
1
DAC Analog Output Skew
1
Output delay measured from the 50% point of the rising edge of the input clock to the 50% point of the DAC output full-scale transition.
Conditions
R
SET
= 510 Ω, R
L
= 37.5 Ω
R
SET
= 4.12 kΩ, R
L
= 300 Ω
DAC 1, DAC 2, DAC 3
DAC 1, DAC 2, DAC 3
Min
33
0
Typ
34.6
4.3
2.0
10
6
1
Max
37
1.4
Unit
mA
mA
%
V
pF
ns
ns
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PDF描述 |
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