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參數(shù)資料
| 型號(hào)： | ADV212-HD-EB |
| 廠商： | Analog Devices Inc |
| 文件頁(yè)數(shù)： | 41/44頁(yè) |
| 文件大?。?/td> | 0K |
| 描述： | BOARD EVALUATION FOR ADV212-HD |
| 標(biāo)準(zhǔn)包裝： | 1 |
| 主要目的： | 視頻，視頻處理 |
| 嵌入式： | 是，F(xiàn)PGA / CPLD |
| 已用 IC / 零件： | ADV212-HD |
| 主要屬性： | 與 1080i 和 720p SDI 兼容，32/64 位，33/66 MHz PCI 卡 |
| 次要屬性： | GUI，JPEG2000 視頻編解碼器 |
| 已供物品： | 板 |
| 相關(guān)產(chǎn)品： | ADV212BBCZRL-150DKR-ND - IC CODEC VID JPEG 2000 144CSPBGA ADV212BBCZRL-115DKR-ND - IC CODEC VID JPEG 2000 121CSPBGA ADV212BBCZRL-150CT-ND - IC CODEC VID JPEG 2000 144CSPBGA ADV212BBCZRL-115CT-ND - IC CODEC VID JPEG 2000 121CSPBGA ADV212BBCZRL-150TR-ND - IC CODEC VID JPEG 2000 144CSPBGA ADV212BBCZRL-115TR-ND - IC CODEC VID JPEG 2000 121CSPBGA ADV212BBCZ-150-ND - IC CODEC VID JPEG 2000 144CSPBGA ADV212BBCZ-115-ND - IC CODEC VID JPEG 2000 121CSPBGA |
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ADV212
Rev. B | Page 6 of 44
NORMAL HOST MODE—WRITE OPERATION
Table 4.
Parameter
Mnemonic
Min
Typ
Max
Unit
WE to ACK, Direct Registers and FIFO Accesses
t
ACK (direct)
5
1.5 × JCLK + 7.01
ns
WE to ACK, Indirect Registers
t
ACK (indirect)
5
2.5 × JCLK + 7.01
ns
Data Setup
tSD
3.0
ns
Data Hold
tHD
1.5
ns
Address Setup
tSA
2
ns
Address Hold
tHA
2
ns
CS to WE Setup
tSC
0
ns
CS Hold
tHC
0
ns
Write Inactive Pulse Width (Minimum Time Until Next WE Pulse)
tWH
2.5 JCLK1
ns
Write Active Pulse Width
tWL
2.5 JCLK1
ns
Write Cycle Time
tWCYC
5 JCLK1
ns
1
For a definition of JCLK, see Figure 32.
ADDR
HDATA
tSA
tSC
tHC
tWL
tACK
tHD
tSD
tWH
tWCYC
tHA
CS
WE
ACK
VALID
06389-
012
Figure 3. Normal Host Mode—Write Operation
相關(guān)PDF資料 |
PDF描述 |
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