參數(shù)資料
型號(hào)： ADSP-BF542BBCZ-5A
廠商： ANALOG DEVICES INC
元件分類： 數(shù)字信號(hào)處理
英文描述： 533 MHz Blackfin Embedded Processor: ADSP-BF542BBCZ-5A Temp Range: –40°C to +85°C Package: 400-Ball CSP_BGA BC-400-1
中文描述： 16-BIT, 50 MHz, OTHER DSP, PBGA400
封裝： 17 X 17 MM, ROHS COMPLIANT, CSBGA-400
文件頁(yè)數(shù)： 67/100頁(yè)
文件大小： 3095K
代理商： ADSP-BF542BBCZ-5A
ADSP-BF542/ADSP-BF544/ADSP-BF547/ADSP-BF548/ADSP-BF549
Rev. D
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May 2011
SD/SDIO Controller Timing
Table 50 and Figure 44 describe SD/SDIO controller timing.
Table 51 and Figure 45 describe SD/SDIO controller (high-
speed mode) timing.
Table 50. SD/SDIO Controller Timing
Parameter
Min
Max
Unit
Timing Requirements
tISU
SD_Dx and SD_CMD Input Setup Time
7.2
ns
tIH
SD_Dx and SD_CMD Input Hold Time
2
ns
Switching Characteristics
fPP
SD_CLK Frequency During Data Transfer Mode
1
020
MHz
fOD
SD_CLK Frequency During Identification Mode
100
2
400
kHz
tWL
SD_CLK Low Time
15
ns
tWH
SD_CLK High Time
15
ns
tTLH
SD_CLK Rise Time
10
ns
tTHL
SD_CLK Fall Time
10
ns
tODLY
SD_Dx and SD_CMD Output Delay Time During Data Transfer Mode
–1
14
ns
tODLY
SD_Dx and SD_CMD Output Delay Time During Identification Mode
–1
50
ns
1 t
PP=1/fPP
2 Spec can be 0 kHz, meaning to stop the clock. The given minimum frequency range is for cases where a continuous clock is required.
Figure 44. SD/SDIO Controller Timing
SD_CLK
INPUT
OUTPUT
tISU
NOTES:
1 INPUT INCLUDES SD_Dx AND SD_CMD SIGNALS.
2 OUTPUT INCLUDES SD_Dx AND SD_CMD SIGNALS.
tTHL
tTLH
tWL
tWH
tPP
tIH
tODLY
VOH (MIN)
VOL (MAX)
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PDF描述
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