參數(shù)資料
型號: ADSP-BF512KBCZ-4
廠商: Analog Devices Inc
文件頁數(shù): 44/68頁
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描述: IC DSP 16/32B 400MHZ 168CSPBGA
標準包裝: 1
系列: Blackfin®
類型: 定點
接口: I²C,PPI,SPI,SPORT,UART/USART
時鐘速率: 400MHz
非易失內(nèi)存: 外部
芯片上RAM: 116kB
電壓 - 輸入/輸出: 1.8V,2.5V,3.3V
電壓 - 核心: 1.30V
工作溫度: 0°C ~ 70°C
安裝類型: 表面貼裝
封裝/外殼: 168-LFBGA,CSPBGA
供應(yīng)商設(shè)備封裝: 168-CSPBGA(12x12)
包裝: 托盤
ADSP-BF512/BF512F, BF514/BF514F, BF516/BF516F, BF518/BF518F
Rev. B
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January 2011
JTAG Test And Emulation Port Timing
Table 49 and Figure 37 describe JTAG port operations.
Table 49. JTAG Port Timing
Parameter
Min
Max
Unit
Timing Requirements
tTCK
TCK Period
20
ns
tSTAP
TDI, TMS Setup Before TCK High
4
ns
tHTAP
TDI, TMS Hold After TCK High
4
ns
tSSYS
1
System Inputs Setup Before TCK High
4
ns
tHSYS
System Inputs Hold After TCK High
5
ns
tTRSTW
TRST Pulse Width
2 (measured in TCK cycles)
4
TCK
Switching Characteristics
tDTDO
TDO Delay from TCK Low
10
ns
tDSYS
3
System Outputs Delay After TCK Low
0
13
ns
1 System Inputs = DATA15–0, SCL, SDA, TFS0, TSCLK0, RSCLK0, RFS0, DR0PRI, DR0SEC, PF15–0, PG15–0, PH7–0, MDIO, TD1, TMS, RESET, NMI, BMODE2–0.
2 50 MHz Maximum
3 System Outputs = DATA15–0, ADDR19–1, ABE1–0, ARE, AWE, AMS1–0, SRAS, SCAS, SWE, SCKE, CLKOUT, SA10, SMS, SCL, SDA, TSCLK0, TFS0, RFS0, RSCLK0,
DT0PRI, DT0SEC, PF15–0, PG15–0, PH7–0, MDC, MDIO.
Figure 37. JTAG Port Timing
TCK
TMS
TDI
TDO
SYSTEM
INPUTS
SYSTEM
OUTPUTS
tTCK
tSTAP
tHTAP
tDTDO
tSSYS
tHSYS
tDSYS
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PDF描述
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參數(shù)描述
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