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參數(shù)資料
型號(hào): ADSP-BF512BBCZ-3
廠商: Analog Devices Inc
文件頁(yè)數(shù): 35/68頁(yè)
文件大?。?/td> 0K
描述: IC DSP 16/32B 300MHZ 168CSPBGA
標(biāo)準(zhǔn)包裝: 1
系列: Blackfin®
類(lèi)型: 定點(diǎn)
接口: I²C,PPI,SPI,SPORT,UART/USART
時(shí)鐘速率: 300MHz
非易失內(nèi)存: 外部
芯片上RAM: 116kB
電壓 - 輸入/輸出: 1.8V,2.5V,3.3V
電壓 - 核心: 1.30V
工作溫度: -40°C ~ 85°C
安裝類(lèi)型: 表面貼裝
封裝/外殼: 168-LFBGA,CSPBGA
供應(yīng)商設(shè)備封裝: 168-CSPBGA(12x12)
包裝: 托盤(pán)
Rev. B
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January 2011
ADSP-BF512/BF512F, BF514/BF514F, BF516/BF516F, BF518/BF518F
Table 36. External Late Frame Sync
VDDEXT
1.8V Nominal
VDDEXT
2.5 V/3.3V Nominal
Parameter
Min
Max
Min
Max
Unit
Switching Characteristics
tDDTLFSE
1, 2
Data Delay from Late External TFSx or External RFSx with
MCE = 1, MFD = 0
12
10
ns
tDTENLFSE
Data Enable from Late FS or MCE = 1, MFD = 0
0
ns
1 MCE = 1, TFSx enable and TFSx valid follow tDDTENFS and tDDTLFSE.
2 If external RFSx/TFSx setup to RSCLKx/TSCLKx > tSCLKE/2 then tDDTTE/I and tDTENE/I apply, otherwise tDDTLFSE and tDTENLFS apply.
Figure 24. External Late Frame Sync
RSCLKx
RFSx
DTx
DRIVE
EDGE
DRIVE
EDGE
SAMPLE
EDGE
EXTERNAL RFSx IN MULTI-CHANNEL MODE
1ST BIT
tDTENLFSE
tDDTLFSE
TSCLKx
TFSx
DTx
DRIVE
EDGE
DRIVE
EDGE
SAMPLE
EDGE
LATE EXTERNAL TFSx
1ST BIT
tDDTLFSE
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參數(shù)描述
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