參數(shù)資料
型號： ADSP-21160MKB-80
廠商： ANALOG DEVICES INC
元件分類： 數(shù)字信號處理
英文描述： DSP Microcomputer
中文描述： 64-BIT, 80 MHz, OTHER DSP, PBGA400
封裝： 27 X 27 MM, METRIC, PLASTIC, BGA-400
文件頁數(shù)： 30/53頁
文件大?。?/td> 696K
代理商： ADSP-21160MKB-80
ADSP-21160M
–
30
–
REV. 0
Three-State Timing
—
Bus Master and Bus Slave
These specifications show how the memory interface is
disabled (stops driving) or enabled (resumes driving)
relative to CLKIN and the SBTS pin. This timing is appli-
cable to bus master transition cycles (BTC) and host
transition cycles (HTC) as well as the SBTS pin.
Table 16. Three-State Timing
—
Bus Slave, HBR, SBTS
Parameter
Timing Requirements:
t
STSCK
t
HTSCK
Switching Characteristics:
t
MIENA
t
MIENS
t
MIENHG
t
MITRA
t
MITRS
t
MITRHG
t
DATEN
t
DATTR
t
ACKEN
t
ACKTR
t
CDCEN
t
CDCTR
t
MTRHBG
Min
Max
Unit
SBTS Setup Before CLKIN
SBTS
Hold After CLKIN
6
1
ns
ns
Address/Select Enable After CLKIN
Strobes Enable After CLKIN
1
HBG Enable After CLKIN
Address/Select Disable After CLKIN
Strobes Disable After CLKIN
1
HBG Disable After CLKIN
Data Enable After CLKIN
2
Data Disable After CLKIN
2
ACK Enable After CLKIN
2
ACK Disable After CLKIN
2
CLKOUT Enable After CLKIN
CLKOUT Disable After CLKIN
Memory Interface Disable Before HBG
Low
3
Memory Interface Enable After HBG
High
3
1.5
1.5
1.5
0.25t
CCLK
–
1
0.25t
CCLK
–
4
3.5
1.5
1.5
1.5
1.5
1.5
t
CCLK
–
3
t
CK
–
6
9
9
9
0.25t
CCLK
+4
0.25t
CCLK
8
10
5
9
5
9
t
CCLK
+1
t
CK
+2
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
t
MENHBG
t
CK
–
5
t
CK
+5
ns
1
Strobes = RDx, WRx, DMAGx.
2
In addition to bus master transition cycles, these specs also apply to bus master and bus slave synchronous read/write.
3
Memory Interface = Address, RDx, WRx, MSx, PAGE, DMAGx, and BMS (in EPROM boot mode).
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