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參數(shù)資料
| 型號： | ADG5412BCPZ-REEL7 |
| 廠商： | Analog Devices Inc |
| 文件頁數(shù)： | 20/20頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC SWITCH QUAD SPST 16LFCSP |
| 標準包裝： | 1 |
| 功能： | 開關(guān) |
| 電路： | 4 x SPST - NO |
| 導通狀態(tài)電阻： | 12 歐姆 |
| 電壓電源： | 單/雙電源 |
| 電壓 - 電源，單路/雙路(±)： | 9 V ~ 40 V，±9 V ~ ±22 V |
| 電流 - 電源： | 80µA |
| 工作溫度： | -40°C ~ 125°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 16-WQFN 裸露焊盤，CSP |
| 供應商設備封裝： | 16-LFCSP-WQ（4x4） |
| 包裝： | 標準包裝 |
| 其它名稱： | ADG5412BCPZ-REEL7DKR |
ADG5412/ADG5413
Rev. A | Page 9 of 20
PIN CONFIGURATIONS AND FUNCTION DESCRIPTIONS
IN1 1
D1 2
S1 3
VSS 4
IN2
16
D2
15
S2
14
VDD
13
GND 5
NC
12
S4 6
S3
11
D4 7
D3
10
IN4 8
IN3
9
NC = NO CONNECT
ADG5412/
ADG5413
TOP VIEW
(Not to Scale)
09
20
2-
00
2
Figure 2. TSSOP Pin Configuration
NOTES
1. EXPOSED PAD TIED TO SUBSTRATE, VSS.
2. NC = NO CONNECT.
PIN 1
INDICATOR
1
S1
2
VSS
3
GND
4
S4
11 VDD
12 S2
10 NC
9S3
5
D
4
6
IN
4
7
IN
3
8
D
3
15
IN
1
16
D
1
14
IN
2
13
D
2
ADG5412/
ADG5413
TOP VIEW
(Not to Scale)
09
20
2-
0
03
Figure 3. LFCSP Pin Configuration
Table 7. Pin Function Descriptions
Pin No.
TSSOP
LFCSP
Mnemonic
Description
1
15
IN1
Logic Control Input 1.
2
16
D1
Drain Terminal 1. This pin can be an input or output.
3
1
S1
Source Terminal 1. This pin can be an input or output.
4
2
VSS
Most Negative Power Supply Potential.
5
3
GND
Ground (0 V) Reference.
6
4
S4
Source Terminal 4. This pin can be an input or output.
7
5
D4
Drain Terminal 4. This pin can be an input or output.
8
6
IN4
Logic Control Input 4.
9
7
IN3
Logic Control Input 3.
10
8
D3
Drain Terminal 3. This pin can be an input or output.
11
9
S3
Source Terminal 3. This pin can be an input or output.
12
10
NC
No Connection.
13
11
VDD
Most Positive Power Supply Potential.
14
12
S2
Source Terminal 2. This pin can be an input or output.
15
13
D2
Drain Terminal 2. This pin can be an input or output.
16
14
IN2
Logic Control Input 2.
EP
Exposed Pad
The exposed pad is connected internally. For increased reliability of the solder joints
and maximum thermal capability, it is recommended that the pad be soldered to the
substrate, VSS.
Table 8. ADG5412 Truth Table
INx
Switch Condition
1
On
0
Off
Table 9. ADG5413 Truth Table
INx
S1, S4
S2, S3
0
Off
On
1
On
Off
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PDF描述 |
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