參數(shù)資料
型號: ADF4212LBRUZ
廠商: Analog Devices Inc
文件頁數(shù): 8/28頁
文件大?。?/td> 0K
描述: IC PLL FREQ SYNTHESIZER 20TSSOP
標準包裝: 75
類型: 時鐘/頻率合成器(RF/IF)
PLL:
輸入: CMOS,TTL
輸出: 時鐘
電路數(shù): 1
比率 - 輸入:輸出: 3:1
差分 - 輸入:輸出: 是/是
頻率 - 最大: 2.4GHz
除法器/乘法器: 是/無
電源電壓: 2.7 V ~ 3.3 V
工作溫度: -40°C ~ 85°C
安裝類型: 表面貼裝
封裝/外殼: 20-TSSOP(0.173",4.40mm 寬)
供應(yīng)商設(shè)備封裝: 20-TSSOP
包裝: 管件
ADF4212L
Data Sheet
Rev. E | Page 16 of 28
IF R COUNTER LATCH
Table 8. IF R Counter Latch Map
15-BIT IF REFERENCE COUNTER
CONTROL
BITS
DB0
DB1
DB2
DB3
DB4
DB5
DB6
DB7
DB8
DB9
DB10
DB11
DB12
DB13
DB14
DB15
DB16
DB17
DB18
DB19
DB20
C1 (0)
C2 (0)
R1
R2
R3
R4
R5
R6
R7
R8
R9
R10
R11
R12
R13
R14
P2
P3
P4
IF
F
O
L
O
CK
DE
T
E
CT
PR
EC
ISI
O
N
T
H
R
EE-ST
A
T
E
CP
IF
P
D
P
OLA
R
ITY
P1
IF CP CURRENT
SETTING
DB23
IFCP2
DB22
IFCP1
DB21
IFCP0
R15
0
.
1
0
.
1
0
.
1
..........
0
1
.
1
0
1
0
.
0
1
0
1
0
.
0
1
0
1
2
3
4
.
32764
32765
32766
32767
R15
R14
R13
..........
R3
R2
R1
DIVIDE RATIO
0
1
NEGATIVE
POSITIVE
P1
IF PD POLARITY
0
1
NORMAL
THREE-STATE
P2
CHARGE PUMP
OUTPUT
0
1
0
1
0
1
0
1
0
1
0
1
0
1
0
1
0
1
0
1
0
1
0
1
0
1
0
1
0
1
LOGIC LOW STATE
IF ANALOG LOCK DETECT
IF REFERENCE DIVIDER OUTPUT
IF N DIVIDER OUTPUT
RF ANALOG LOCK DETECT
RF/IF ANALOG LOCK DETECT
IF DIGITAL LOCK DETECT
LOGIC HIGH STATE
RF REFERENCE DIVIDER OUTPUT
RF N DIVIDER OUTPUT
THREE-STATE OUTPUT
IF COUNTER RESET
RF DIGITAL LOCK DETECT
RF/IF DIGITAL LOCK DETECT
RF COUNTER RESET
IF AND RF COUNTER RESET
P12
P11
P4
P3
MUXOUT
FROM RF R LATCH
0
1
0
1
0
1
0
1
0
1
0
1
0
1
ICP (mA)
1.5k
2.7k
5.6k
IFCP2
IFCP1
IFCP0
1.1250
2.2500
3.3750
4.5000
5.6250
6.7500
7.7875
9.0000
0.625
1.250
1.875
2.500
3.125
3.750
4.375
5.000
0.301
0.602
0.904
1.205
1.506
1.808
2.109
2.411
02774-
032
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