參數(shù)資料
型號： ADF4212LBCPZ-RL
廠商： Analog Devices Inc
文件頁數(shù)： 11/28頁
文件大?。?/td> 0K
描述： IC PLL FREQ SYNTHESIZER 20LFCSP
標準包裝： 5,000
類型： 時鐘/頻率合成器（RF/IF）
PLL： 是
輸入： CMOS，TTL
輸出： 時鐘
電路數(shù)： 1
比率 - 輸入:輸出： 3:1
差分 - 輸入:輸出： 是/是
頻率 - 最大： 2.4GHz
除法器/乘法器： 是/無
電源電壓： 2.7 V ~ 3.3 V
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 20-VFQFN 裸露焊盤，CSP
供應商設(shè)備封裝： 20-LFCSP-VQ
包裝： 帶卷 (TR)
Data Sheet
ADF4212L
Rev. E | Page 19 of 28
RF N COUNTER LATCH
Table 11. RF N Counter Latch Map
12-BIT B COUNTER
CONTROL
BITS
DB0
DB1
DB2
DB3
DB4
DB5
DB6
DB7
DB8
DB9
DB10
DB11
DB12
DB13
DB14
DB15
DB16
DB17
DB18
DB19
DB20
C1 (1)
C2 (1)
A1
A2
A3
A4
A5
A6
B1
B2
B3
B4
B5
B6
B7
B8
B11
B12
P14
B10
RF
PRESCALER
DB23
P17
DB22
P16
DB21
P15
B9
RF
CP
GA
IN
RF
PO
W
ER
-D
O
W
N
6-BIT A COUNTER
0
.
1
0
.
1
0
.
1
..........
0
1
.
1
0
.
0
1
0
.
0
1
0
1
3
4
.
4092
4093
4094
4095
B12
B11
B10
B3
B2
B1
B COUNTER DIVIDE RATIO
0
.
1
0
.
1
..........
0
1
0
.
0
1
0
1
0
1
.
0
1
0
1
0
1
2
3
.
60
61
62
63
A6
A5
..........
A2
A1
A COUNTER
DIVIDE RATIO
0
1
8/9
16/17
32/33
64/65
P15
PRESCALER VALUE
0
1
0
1
P14
0
1
DISABLED
ENABLED
P16 RF POWER-DOWN
0
1
DISABLED
ENABLED
P17 RF CP GAIN
N = BP + A, P IS PRESCALER VALUE SET IN THE FUNCTION LATCH
B MUST BE GREATER THAN OR EQUAL TO A
FOR CONTIGUOUS VALUES OF N, NMIN IS (P2 – P)
02774-
035
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PDF描述
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