參數(shù)資料
型號(hào): ADF4154BRU
廠商: Analog Devices Inc
文件頁(yè)數(shù): 14/24頁(yè)
文件大小: 0K
描述: IC FRAC-N FREQ SYNTH 16-TSSOP
標(biāo)準(zhǔn)包裝: 96
類型: 分?jǐn)?shù) N 合成器(RF)
PLL:
輸入: CMOS,TTL
輸出: 時(shí)鐘
電路數(shù): 1
比率 - 輸入:輸出: 2:1
差分 - 輸入:輸出: 是/無(wú)
頻率 - 最大: 4GHz
除法器/乘法器: 無(wú)/是
電源電壓: 2.7 V ~ 3.3 V
工作溫度: -40°C ~ 85°C
安裝類型: 表面貼裝
封裝/外殼: 16-TSSOP(0.173",4.40mm 寬)
供應(yīng)商設(shè)備封裝: 16-TSSOP
包裝: 管件
配用: EVAL-ADF4154EBZ1-ND - BOARD EVALUATION FOR ADF4154EB1
Data Sheet
ADF4154
Rev. C | Page 21 of 24
PCB DESIGN GUIDELINES FOR CHIP SCALE
PACKAGE
The lands on the chip scale package (CP-20-1) are rectangular.
The printed circuit board pad for these should be 0.1 mm
longer than the package land length and 0.05 mm wider than
the package land width. The land should be centered on the
pad. This ensures that the solder joint size is maximized.
The bottom of the chip scale package has a central thermal pad.
The thermal pad on the printed circuit board should be at least
as large as this exposed pad. On the printed circuit board, there
should be a clearance of at least 0.25 mm between the thermal
pad and the inner edges of the pad pattern to avoid shorting.
Thermal vias may be used on the printed circuit board thermal
pad to improve thermal performance of the package. If vias
are used, they should be incorporated into the thermal pad at
1.2 mm pitch grid. The via diameter should be between 0.3 mm
and 0.33 mm, and the via barrel should be plated with 1 oz of
copper to plug the via.
The user should connect the printed circuit board thermal pad
to AGND.
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PDF描述
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參數(shù)描述
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