參數(shù)資料
型號： ADF4118BRU-REEL7
廠商： Analog Devices Inc
文件頁數(shù)： 7/28頁
文件大?。?/td> 0K
描述： IC PLL FREQ SYNTHESIZER 16-TSSOP
標準包裝： 1,000
類型： 時鐘/頻率合成器，RF
PLL： 是
輸入： CMOS，TTL
輸出： 時鐘
電路數(shù)： 1
比率 - 輸入:輸出： 2:1
差分 - 輸入:輸出： 是/無
頻率 - 最大： 3GHz
除法器/乘法器： 是/無
電源電壓： 2.7 V ~ 5.5 V
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 16-TSSOP（0.173"，4.40mm 寬）
供應(yīng)商設(shè)備封裝： 16-TSSOP
包裝： 帶卷 (TR)
配用： EVAL-ADF4118EBZ1-ND - BOARD EVAL FOR ADF4118
ADF4116/ADF4117/ADF4118
Rev. D | Page 15 of 28
LATCH MAPS
R14
0
1
R13
0
1
R12
0
1
R3
R2
R1
DIVIDE RATIO
0
1
1
0
1
0
0
1
0
1
0
0
1
0
1
2
3
4
163 80
163 81
163 82
163 83
TEST MODE BITS SHOULD
BE SET TO 0000 FOR
NORMAL OPERATION
OPERATION
LDP
3 CONSECUTIVE CYCLES OF PHASE DELAY LESS THAN
15ns MUST OCCUR BEFORE LOCK DETECT IS SET.
5 CONSECUTIVE CYCLES OF PHASE DELAY LESS THAN
15ns MUST OCCUR BEFORE LOCK DETECT IS SET.
0
1
LO
C
K
DE
T
E
C
T
PR
EC
ISI
O
N
TEST
MODE BITS
DB20
DB19
DB18
DB17
DB16
DB15
DB14
DB13
DB12
DB11
DB9
DB8
DB7
DB6
DB5
DB4
DB3
DB2
DB1
DB0
DB10
LDP
T4
T3
T2
T1
R14
R13
R12
R11
R10
R8
R7
R6
R5
R4
R3
R2
R1
C2 (0)
C1 (0)
R9
14-BIT REFERENCE COUNTER, R
CONTROL
BITS
00
39
2-
0
31
Figure 31. Reference Counter Latch Map
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PDF描述
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