AVDD = DV
參數(shù)資料
型號： ADF4108BCPZ-RL
廠商： Analog Devices Inc
文件頁數(shù)： 16/20頁
文件大?。?/td> 0K
描述： IC PLL FREQUENCY SYNTH 20-LFCSP
標準包裝： 5,000
類型： 時鐘/頻率合成器，RF
PLL： 是
輸入： CMOS，TTL
輸出： 時鐘
電路數(shù)： 1
比率 - 輸入:輸出： 2:1
差分 - 輸入:輸出： 是/無
頻率 - 最大： 8GHz
除法器/乘法器： 無/無
電源電壓： 3.2 V ~ 3.6 V
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 20-VFQFN 裸露焊盤，CSP
供應商設(shè)備封裝： 20-LFCSP-VQ
包裝： 帶卷 (TR)
Data Sheet
ADF4108
Rev. E | Page 5 of 20
TIMING CHARACTERISTICS
AVDD = DVDD = 3.3 V ± 2%, AVDD ≤ VP ≤ 5.5 V, AGND = DGND = CPGND = 0 V, RSET = 5.1 kΩ, dBm referred to 50 Ω, TA = TMIN to
TMAX, unless otherwise noted.
Table 2.
Parameter1
Limit2 (B Version)
Unit
Test Conditions/Comments
t1
10
ns min
DATA to CLOCK setup time
t2
10
ns min
DATA to CLOCK hold time
t3
25
ns min
CLOCK high duration
t4
25
ns min
CLOCK low duration
t5
10
ns min
CLOCK to LE setup time
t6
20
ns min
LE pulse width
1 Guaranteed by design but not production tested.
2 Operating temperature range (B Version) is 40°C to +85°C.
CLOCK
DB22
DB2
DATA
LE
t1
LE
DB23 (MSB)
t2
DB1
(CONTROL BIT C2)
DB0 (LSB)
(CONTROL BIT C1)
t3
t4
t6
t5
06
01
5-
0
02
Figure 2. Timing Diagram
相關(guān)PDF資料
PDF描述
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參數(shù)描述
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