VREFx
參數(shù)資料
型號： ADCLK948/PCBZ
廠商： Analog Devices Inc
文件頁數(shù)： 3/12頁
文件大?。?/td> 0K
描述： BOARD EVALUATION FOR ADCLK948
設(shè)計資源： ADCLK948 Eval Brd Schematic
ADCLK948 Gerber Files
ADCLK948 BOM
標準包裝： 1
系列： SIGe
主要目的： 計時，時鐘緩沖器 / 驅(qū)動器 / 接收器 / 變換器
已用 IC / 零件： ADCLK948
主要屬性： 2 個可選輸入，8 輸出
次要屬性： LVPECL 輸出邏輯
已供物品： 板
ADCLK948
Rev. A | Page 11 of 12
INPUT TERMINATION OPTIONS
VREFx
VCC
VTx
CLKx
CONNECT VTxTO VCC.
50
08
28
0-
01
9
ADCLK948
Figure 19. DC-Coupled CML Input Termination
VREFx
VTx
VCC
50
CLKx
08
280
-02
0
0.01F
(OPTIONAL)
50
ADCLK948
Figure 20. DC-Coupled LVPECL Input Termination
VREFx
VTx
CONNECT VTxTO VREFx.
50
CLKx
08
28
0
-02
1
ADCLK948
Figure 21. AC-Coupled Input Termination, Such as LVDS and LEVPECL
VREFx
VTx
CONNECT VTx, VREFx, AND CLKx. PLACE A
BYPASS CAPACITOR FROM VTx TO GROUND.
ALTERNATIVELY, VTx, VREFx, AND CLKx CAN BE
CONNECTED, GIVING A CLEANER LAYOUT AND
A 180 PHASE SHIFT.
50
CLKx
08
28
0-
0
22
ADCLK948
Figure 22. AC-Coupled Single-Ended Input Termination
VREFx
VTx
50
CLKx
082
80
-02
3
ADCLK948
Figure 23. DC-Coupled 3.3 V CMOS Input Termination
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PDF描述
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