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參數(shù)資料
| 型號： | ADCLK946BCPZ-REEL7 |
| 廠商： | Analog Devices Inc |
| 文件頁數(shù)： | 9/12頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC CLK BUFFER 1:6 4.8GHZ 24LFCSP |
| 標準包裝： | 1,500 |
| 系列： | SIGe |
| 類型： | 扇出緩沖器（分配） |
| 電路數(shù)： | 1 |
| 比率 - 輸入:輸出： | 1:6 |
| 差分 - 輸入:輸出： | 是/是 |
| 輸入： | CML，CMOS，LVDS，LVPECL |
| 輸出： | LVPECL |
| 頻率 - 最大： | 4.8GHz |
| 電源電壓： | 2.97 V ~ 3.63 V |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 24-VFQFN 裸露焊盤，CSP |
| 供應商設備封裝： | 24-LFCSP-VQ（4x4） |
| 包裝： | 帶卷 (TR) |
ADCLK946
Rev. A | Page 6 of 12
PIN CONFIGURATION AND FUNCTION DESCRIPTIONS
PIN 1
INDICATOR
1
VEE
2
CLK
3
CLK
4
VREF
5
VT
6
VEE
15 Q3
16 Q2
17 Q2
18 VCC
14 Q3
13 VCC
7
V
EE
8
Q5
9
Q5
11
Q4
12
V
EE
10
Q4
21
Q1
22
Q0
23
Q0
24
V
CC
20
Q1
19
V
EE
ADCLK946
TOP VIEW
(Not to Scale)
NOTES:
1. EXPOSED PADDLE MUST BE CONNECTED TO VEE.
08053-
002
Figure 2. Pin Configuration
Table 6. Pin Function Descriptions
Pin No.
Mnemonic
Description
1, 6, 7, 12, 19
VEE
Negative Supply Pin.
2
CLK
Differential Input (Positive).
3
CLK
Differential Input (Negative).
4
VREF
Reference Voltage. This pin provides the reference voltage for biasing ac-coupled CLK and CLK inputs.
5
VT
Center Tap. This pin provides the center tap of a 100 input resistor for CLK and CLK inputs.
8, 9
Q5, Q5
Differential LVPECL Outputs.
10, 11
Q4, Q4
Differential LVPECL Outputs.
13, 18, 24
VCC
Positive Supply Pin.
14, 15
Q3, Q3
Differential LVPECL Outputs.
16, 17
Q2, Q2
Differential LVPECL Outputs.
20, 21
Q1, Q1
Differential LVPECL Outputs.
22, 23
Q0, Q0
Differential LVPECL Outputs.
EPAD
EPAD must be soldered to VEE.
相關PDF資料 |
PDF描述 |
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