參數(shù)資料
型號： ADC1207S080HW
廠商： NXP Semiconductors N.V.
元件分類： 外設(shè)及接口
英文描述： Single 12 bits ADC, up to 80 MHz with direct-ultra high IF sampling
封裝： ADC1207S080HW/C1<SOT545-2 (HTQFP48)|<<http://www.nxp.com/packages/SOT545-2.html<1<Always Pb-free,;ADC1207S080HW/C1<SOT545-2 (HTQFP48)|<<http://www.nxp.com/packages/SOT545
文件頁數(shù)： 10/21頁
文件大小： 129K
代理商： ADC1207S080HW
ADC1207S080_2
NXP B.V. 2008. All rights reserved.
Product data sheet
Rev. 02 — 7 August 2008
10 of 21
NXP Semiconductors
ADC1207S080
Single 12 bits ADC, up to 80 MHz with direct/ultra high IF sampling
10. Additional information relating to
Table 5
[1]
X = don’t care.
Table 6.
V
i(IN)
V
i(INN)
= 1.9 V; V
ref(fs)
= V
CCA1
1.87 V; typical values to AGND.
Code
V
i(IN)
(V) V
i(INN)
(V) IR
Output coding with differential inputs
Binary outputs
(D11 to D0)
0000 0000 0000
0000 0000 0000
0000 0000 0001
↓
0111 1111 1111
↓
1111 1111 1110
1111 1111 1111
1111 1111 1111
Two’s complement outputs
(D11 to D0)
1000 0000 0000
1000 0000 0000
1000 0000 0001
↓
1111 1111 1111
↓
0111 1111 1110
0111 1111 1111
0111 1111 1111
Underflow
0
1
↓
2047
↓
4094
4095
Overflow
< 2.675
2.675
-
↓
3.15
↓
-
3.625
> 3.625
> 3.625
3.625
-
↓
3.15
↓
-
2.675
< 2.675
0
1
1
↓
1
↓
1
1
0
Table 7.
Two’s complement output (OTC) Chip enable input (CE_N) Data output (D0 to D11; IR)
0
0
1
0
X
[1]
1
Mode selection
binary; active
two’s complement; active
high-impedance
Fig 3.
Output timing diagram
IN
CLK
0.5 V
n
D0 to D11
V
CCO
0.5 V
50 %
data
n
1
data
n
data
n + 1
t
d(o)
t
d(s)
t
h(o)
014aaa432
sample
n
sample
n + 1
sample
n + 2
sample
n + 3
sample
n + 4
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PDF描述
ADC1207S080
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ADC1207S080HW/C1,518 制造商:NXP Semiconductors 功能描述:Cut Tape 制造商:NXP Semiconductors 功能描述:0
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