參數(shù)資料
型號(hào)： AD9847AKSTZ
廠商： Analog Devices Inc
文件頁(yè)數(shù)： 15/28頁(yè)
文件大?。?/td> 0K
描述： IC CCD SIGNAL PROC 10BIT 48-LQFP
標(biāo)準(zhǔn)包裝： 1
類型： CCD 信號(hào)處理器，10 位
輸入類型： 邏輯
輸出類型： 邏輯
接口： 3 線串口
安裝類型： 表面貼裝
封裝/外殼： 48-LQFP
供應(yīng)商設(shè)備封裝： 48-LQFP（7x7）
包裝： 托盤
REV. A
AD9847
–22–
22
0
33
1
VD
NOTES
1. VD FALLING EDGE WILL RESET THE PxGA GAIN REGISTER STEERING TO “0101” LINE.
2. HD FALLING EDGES WILL ALTERNATE THE PxGA GAIN REGISTER STEERING BETWEEN “0101” AND “2323” LINES.
3. FLD STATUS IS IGNORED.
HD
11
0
X
PxGA GAIN
REGISTER
FLD
0
ODD FIELD
EVEN FIELD
02
2
0
33
1
11
0
Figure 16a. Mosaic Separate Mode
00
0
11
1
VD
NOTES
1. FLD FALLING EDGE (START OF ODD FIELD) WILL RESET THE PxGA GAIN REGISTER STEERING TO “0101” LINE.
2. FLD RISING EDGE (START OF EVEN FIELD) WILL RESET THE PxGA GAIN REGISTER STEERING TO “2323“ LINE.
3. HD FALLING EDGES WILL RESET THE PxGA GAIN REGISTER STEERING TO EITHER “0” (FLD = ODD) OR “2” (FLD = EVEN).
HD
11
0
X
PxGA GAIN
REGISTER
FLD
0
ODD FIELD
EVEN FIELD
02
2
33
3
33
2
0
Figure 16b. Mosaic Interlaced Mode
11
0
22
1
VD
NOTES
1. VD FALLING EDGE WILL RESET THE PxGA GAIN REGISTER STEERING TO “0101” LINE.
2. HD FALLING EDGES WILL ALTERNATE THE PxGA GAIN REGISTER STEERING BETWEEN “0101” AND “1212” LINES.
3. ALL FIELDS WILL HAVE THE SAME PxGA GAIN STEERING PATTERN (FLD STATUS IS IGNORED).
HD
11
0
X
PxGA GAIN
REGISTER
FLD
0
ODD FIELD
EVEN FIELD
01
1
0
22
1
11
0
Figure 16c. Mosaic Repeat Mode
02
0
10
0
1
VD
NOTES
1. EACH LINE FOLLOWS “012012” STEERING PATTERN.
2. VD AND HD FALLING EDGES WILL RESET THE PxGA GAIN REGISTER STEERING TO “0.”
3. FLD STATUS IS IGNORED.
HD
10
2
X
PxGA GAIN
REGISTER
FLD
0
ODD FIELD
EVEN FIELD
20
2
0
10
0
1
10
2
0
2
0
Figure 16d. Three-Color Mode
相關(guān)PDF資料
PDF描述
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