參數(shù)資料
型號(hào)： AD9846AJSTZ
廠商： Analog Devices Inc
文件頁(yè)數(shù)： 8/24頁(yè)
文件大?。?/td> 0K
描述： IC CCD SIGNAL PROC 10BIT 48LQFP
標(biāo)準(zhǔn)包裝： 1
類(lèi)型： CCD 信號(hào)處理器，10 位
輸入類(lèi)型： 邏輯
輸出類(lèi)型： 邏輯
接口： 3 線串口
安裝類(lèi)型： 表面貼裝
封裝/外殼： 48-LQFP
供應(yīng)商設(shè)備封裝： 48-LQFP（7x7）
包裝： 托盤(pán)
REV. 0
AD9846A
–16–
Table IV. Clamp Level Register Contents (Default Value x080)
MSB
LSB
D10
D9
D8
D7
D6
D5
D4
D3
D2
D1
D0
Clamp Level (LSB)
X
0000
0
0000
0001
0.25
0000
0010
0.5
1111
1110
63.5
1111
63.75
Table V. Control Register Contents (Default Value x000)
Data Out
DATACLK
CLP/PBLK
SHP/SHD
PxGA
Color Steering Modes
D10 D9
D8 D7
D6
D5
D4
D3
**
D2 D1 D0
X
0 Enable
0
*
0
*
0 Rising Edge Trigger
0 Active Low 0 Active Low
0 Disable 0
0
0 Steering Disabled
1 Three-State
1 Falling Edge Trigger 1 Active High 1 Active High
1 Enable 0
0
1 Mosaic Separate
0
1
0 Interlace
0
1
1 3-Color
1
0
0 4-Color
1
0
1 VD Selected
1
0 Mosaic Repeat
1
1 User Specied
*Must be set to zero.
**When D3 = 0 (PxGA disabled) the PxGA gain is xed to 4 dB.
Table VI. PxGA Gain Registers for Gain0, Gain1, Gain2, Gain3 (Default Value x000)
MSB
LSB
D10
D9
D8
D7
D6
D5
D4
D3
D2
D1
D0
Gain (dB)
*
XXXXX0
1
1111
+10.0
00
0000+4.3
11
1111+4.0
10
0000
–2.0
*Control Register Bit D3 must be set High (PxGA Enable) to use the PxGA Gain Registers.
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PDF描述
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2081204-7 CONN JACK SMA BULKHEAD RG58
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