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參數(shù)資料
| 型號： | AD9540BCPZ-REEL7 |
| 廠商： | Analog Devices Inc |
| 文件頁數(shù)： | 30/32頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC CLOCK GEN/SYNTHESIZER 48LFCSP |
| 標準包裝： | 750 |
| 類型： | 時鐘發(fā)生器 |
| PLL： | 是 |
| 輸入： | 時鐘 |
| 輸出： | CML，PECL |
| 電路數(shù)： | 1 |
| 比率 - 輸入:輸出： | 2:2 |
| 差分 - 輸入:輸出： | 是/是 |
| 頻率 - 最大： | 655MHz |
| 除法器/乘法器： | 是/無 |
| 電源電壓： | 1.71 V ~ 1.89 V |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 48-VFQFN 裸露焊盤，CSP |
| 供應商設備封裝： | 48-LFCSP-VQ（7x7） |
| 包裝： | 帶卷 (TR) |
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AD9540
Rev. A | Page 7 of 32
Parameter
Min
Typ
Max
Unit
Test Conditions/Comments
I/O_Update to SYNC_OUT Setup Time
7
ns
PS[2:0> to SYNC_OUT Setup Time
7
ns
Latencies/Pipeline Delays
I/O_Update to DAC Frequency Change
33
SYSCLK cycles
I/O_Update to DAC Phase Change
33
SYSCLK cycles
PS[2:0] to DAC Frequency Change
29
SYSCLK cycles
PS[2:0] to DAC Phase Change
29
SYSCLK cycles
I/O_Update to CP_OUT Scaler Change
4
SYSCLK cycles
I/O_Update to Frequency Accumulator
Step Size Change
4
SYSCLK cycles
DAC OUTPUT CHARACTERISTICS
Resolution
10
Bits
Full-Scale Output Current
10
15
mA
Gain Error
10
+10
% fS
Output Offset
0.6
A
Output Capacitance
5
pF
Voltage Compliance Range
AVDD 0.50
AVDD + 0.50
Wideband SFDR (DC to Nyquist)
10 MHz Analog Out
65
dBc
40 MHz Analog Out
62
dBc
80 MHz Analog Out
57
dBc
120 MHz Analog Out
56
dBc
160 MHz Analog Out
54
dBc
Narrow-Band SFDR
10 MHz Analog Out (±1 MHz)
83
dBc
10 MHz Analog Out (±250 kHz)
85
dBc
10 MHz Analog Out (±50 kHz)
86
dBc
40 MHz Analog Out (±1 MHz)
82
dBc
40 MHz Analog Out (±250 kHz)
84
dBc
40 MHz Analog Out (±50 kHz)
87
dBc
80 MHz Analog Out (±1 MHz)
80
dBc
80 MHz Analog Out (±250 kHz)
82
dBc
80 MHz Analog Out (±50 kHz)
86
dBc
120 MHz Analog Out (±1 MHz)
80
dBc
120 MHz Analog Out (±250 kHz)
82
dBc
120 MHz Analog Out (±50 kHz)
84
dBc
160 MHz Analog Out (±1 MHz)
80
dBc
160 MHz Analog Out (±250 kHz)
82
dBc
160 MHz Analog Out (±50 kHz)
84
dBc
DAC RESIDUAL PHASE NOISE
19.7 MHz FOUT
@ 10 Hz Offset
122
dBc/Hz
@ 100 Hz Offset
134
dBc/Hz
@ 1 kHz Offset
143
dBc/Hz
@ 10 kHz Offset
150
dBc/Hz
@ 100 kHz Offset
158
dBc/Hz
>1 MHz Offset
160
dBc/Hz
相關PDF資料 |
PDF描述 |
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