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參數(shù)資料
| 型號(hào)： | AD9219ABCPZRL7-65 |
| 廠商： | Analog Devices Inc |
| 文件頁(yè)數(shù)： | 54/56頁(yè) |
| 文件大小： | 0K |
| 描述： | IC ADC 10BIT SRL 65MSPS 64LFCSP |
| 標(biāo)準(zhǔn)包裝： | 750 |
| 位數(shù)： | 10 |
| 采樣率（每秒）： | 65M |
| 數(shù)據(jù)接口： | 串行，SPI? |
| 轉(zhuǎn)換器數(shù)目： | 4 |
| 功率耗散（最大）： | 408mW |
| 電壓電源： | 模擬和數(shù)字 |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 48-VFQFN 裸露焊盤，CSP |
| 供應(yīng)商設(shè)備封裝： | 48-LFCSP-VQ（7x7） |
| 包裝： | 帶卷 (TR) |
| 輸入數(shù)目和類型： | 8 個(gè)單端，單極；4 個(gè)差分，單極 |
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Data Sheet
AD9219
Rev. E | Page 7 of 56
SWITCHING SPECIFICATIONS
AVDD = 1.8 V, DRVDD = 1.8 V, 2 V p-p differential input, 1.0 V internal reference, AIN = 0.5 dBFS, unless otherwise noted.
Table 4.
AD9219-40
AD9219-65
Temp
Min
Typ
Max
Min
Typ
Max
Unit
Maximum Clock Rate
Full
40
65
MSPS
Minimum Clock Rate
Full
10
MSPS
Clock Pulse Width High (tEH)
Full
12.5
7.7
ns
Clock Pulse Width Low (tEL)
Full
12.5
7.7
ns
OUTPUT PARAMETERS3
Propagation Delay (tPD)
Full
2.0
2.5
3.5
2.0
2.5
3.5
ns
Rise Time (tR) (20% to 80%)
Full
300
ps
Fall Time (tF) (20% to 80%)
Full
300
ps
FCO Propagation Delay (tFCO)
Full
2.0
2.5
3.5
2.0
2.5
3.5
ns
Full
tFCO +
(tSAMPLE/20)
tFCO +
(tSAMPLE/20)
ns
DCO to Data Delay (tDATA)4
Full
(tSAMPLE/20) 300
(tSAMPLE/20)
(tSAMPLE/20) + 300
(tSAMPLE/20) 300
(tSAMPLE/20)
(tSAMPLE/20) + 300
ps
DCO to FCO Delay (tFRAME)4
Full
(tSAMPLE/20) 300
(tSAMPLE/20)
(tSAMPLE/20) + 300
(tSAMPLE/20) 300
(tSAMPLE/20)
(tSAMPLE/20) + 300
ps
Data to Data Skew
(tDATA-MAX tDATA-MIN)
Full
±50
±150
±50
±150
ps
Wake-Up Time (Standby)
25°C
600
ns
Wake-Up Time (Power-Down)
25°C
375
μs
Pipeline Latency
Full
8
CLK
cycles
APERTURE
Aperture Delay (tA)
25°C
500
ps
Aperture Uncertainty (Jitter)
25°C
<1
ps rms
Out-of-Range Recovery Time
25°C
1
2
CLK
cycles
1 See the AN-835 Application Note, Understanding High Speed ADC Testing and Evaluation, for definitions and for details of how these tests were completed.
2 Measured on standard FR-4 material.
3 Can be adjusted via the SPI.
4 tSAMPLE/20 is based on the number of bits divided by 2 because the delays are based on half duty cycles.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| AD9221AR | IC ADC 12BIT 1.5MSPS 28-SOIC |
| AD9222ABCPZRL7-65 | IC ADC 12BIT SRL 65MSPS 64LFCSP |
| AD9224ARSZRL | IC ADC 12BIT 40MSPS 28SSOP |
| AD9225ARS | IC ADC 12BIT 25MSPS 28-SSOP |
| AD9226ASTRL | IC ADC 12BIT 65MSPS 48-LQFP |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| AD9219BCPZ-40 | 制造商:Analog Devices 功能描述:ADC Quad Pipelined 40Msps 10-bit Serial 48-Pin LFCSP EP 制造商:Analog Devices 功能描述:IC 10BIT ADC QUAD 40MSPS LFCSP48 |
| AD9219BCPZ-65 | 制造商:Analog Devices 功能描述:ADC Quad Pipelined 65Msps 10-bit Serial 48-Pin LFCSP EP 制造商:Analog Devices 功能描述:IC 10BIT ADC QUAD 65MSPS LFCSP48 |
| AD9219BCPZRL-40 | 制造商:AD 制造商全稱:Analog Devices 功能描述:Quad, 10-Bit, 40/65 MSPS Serial LVDS 1.8 V A/D Converter |
| AD9219BCPZRL-65 | 制造商:AD 制造商全稱:Analog Devices 功能描述:Quad, 10-Bit, 40/65 MSPS Serial LVDS 1.8 V A/D Converter |
| AD9220 | 制造商:AD 制造商全稱:Analog Devices 功能描述:Complete 12-Bit 1.5/3.0/10.0 MSPS Monolithic A/D Converters |
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