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參數(shù)資料
| 型號： | AD7712* |
| 廠商： | Analog Devices, Inc. |
| 英文描述： | Rail-to-Rail, Very Low Noise Universal Dual Filter Building Block; Package: SSOP; No of Pins: 16; Temperature Range: 0°C to +70°C |
| 中文描述： | LC2MOS信號調理模數(shù)轉換器 |
| 文件頁數(shù)： | 5/28頁 |
| 文件大小： | 229K |
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2
–5–
REV. E
AD7712
TIMING CHARACTERISTICS
1, 2
Limit at T
MIN
, T
MAX
(A, S Versions)
Parameter
f
CLK IN4, 5
Units
Conditions/Comments
Master Clock Frequency: Crystal Oscillator or
Externally Supplied
AV
DD
= +5 V
±
5%
For Specified Performance
AV
DD
= +5.25 V to +10.5 V
Master Clock Input Low Time; t
CLK IN
= 1/f
CLK IN
Master Clock Input High Time
Digital Output Rise Time; Typically 20 ns
Digital Output Fall Time; Typically 20 ns
SYNC
Pulsewidth
400
10
8
0.4
×
t
CLK IN
0.4
×
t
CLK IN
50
50
1000
kHz min
MHz max
MHz
ns min
ns min
ns max
ns max
ns min
t
CLK IN LO
t
CLK IN HI
t
r6
t
f6
t
1
Self-Clocking Mode
t
2
t
3
t
4
t
5
t
6
t
77
t
87
0
0
2
×
t
CLK IN
0
4
×
t
CLK IN
+ 20
4
×
t
CLK IN
+ 20
t
CLK IN
/2
t
CLK IN
/2
+ 30
t
CLK IN
/2
3
×
t
CLK IN
/2
50
0
4
×
t
CLK IN
+ 20
4
×
t
CLK IN
0
10
ns min
ns min
ns min
ns min
ns max
ns max
ns min
ns max
ns nom
ns nom
ns min
ns min
ns max
ns min
ns min
ns min
DRDY
to
RFS
Setup Time; t
CLK IN
= 1/f
CLK IN
DRDY
to
RFS
Hold Time
A0 to
RFS
Setup Time
A0 to
RFS
Hold Time
RFS
Low to SCLK Falling Edge
Data Access Time (
RFS
Low to Data Valid)
SCLK Falling Edge to Data Valid Delay
t
9
t
10
t
14
t
15
t
16
t
17
t
18
t
19
SCLK High Pulsewidth
SCLK Low Pulsewidth
A0 to
TFS
Setup Time
A0 to
TFS
Hold Time
TFS
to SCLK Falling Edge Delay Time
TFS
to SCLK Falling Edge Hold Time
Data Valid to SCLK Setup Time
Data Valid to SCLK Hold Time
(DV
DD
= +5V
6
5%; AV
DD
= +5V or +10 V
3
6
5%; V
SS
6
5%; AGND = DGND =
0 V; f
CLKIN
=10MHz; Input Logic 0 = 0 V, Logic 1 = DV
DD
unless otherwise noted.)
相關PDF資料 |
PDF描述 |
|---|---|
| AD7712 | Signal Conditioning ADC(LC2MOS信號調節(jié)A/D轉換器) |
| AD7713* | LC2MOS Loop-Powered Signal Conditioning ADC |
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相關代理商/技術參數(shù) |
參數(shù)描述 |
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| AD7712ANZ | 功能描述:IC ADC SIGNAL COND LC2MOS 24-DIP RoHS:是 類別:集成電路 (IC) >> 數(shù)據(jù)采集 - 模數(shù)轉換器 系列:- 其它有關文件:TSA1204 View All Specifications 標準包裝:1 系列:- 位數(shù):12 采樣率（每秒）:20M 數(shù)據(jù)接口:并聯(lián) 轉換器數(shù)目:2 功率耗散（最大）:155mW 電壓電源:模擬和數(shù)字 工作溫度:-40°C ~ 85°C 安裝類型:表面貼裝 封裝/外殼:48-TQFP 供應商設備封裝:48-TQFP（7x7） 包裝:Digi-Reel® 輸入數(shù)目和類型:4 個單端，單極；2 個差分，單極 產品目錄頁面:1156 (CN2011-ZH PDF) 其它名稱:497-5435-6 |
| AD7712ANZ | 制造商:Analog Devices 功能描述:IC ADC 24-BIT SIGMA DELTA |
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