參數(shù)資料
型號(hào)： AD724JR
廠商： Analog Devices Inc
文件頁(yè)數(shù)： 13/15頁(yè)
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描述： IC ENCODER RGB TO NTSC 16-SOIC
標(biāo)準(zhǔn)包裝： 47
類(lèi)型： 視頻編碼器
應(yīng)用： RGB 至 NTSC/PAL
電壓 - 電源，數(shù)字： 4.75 V ~ 5.25 V
安裝類(lèi)型： 表面貼裝
封裝/外殼： 16-SOIC（0.295"，7.50mm 寬）
供應(yīng)商設(shè)備封裝： 16-SOIC W
包裝： 管件
AD724
REV. B
–7–
1ST
2ND
3RD
4TH
5TH
6TH
0.00
–0.16
–0.49
–0.53
–0.52
–0.38
0.00
–0.44
–1.14
–1.01
–0.53
–0.01
DG DP (NTSC) (SYNC = EXT)
FIELD = 1 LINE = 27, 100 IRE RAMP
DIFFERENTIAL GAIN (%)
DIFFERENTIAL PHASE (deg)
MIN = –0.53
MAX = 0.00
p–p/MAX = 0.53
MIN = –1.14
MAX = 0.00
pk–pk = 1.14
–0.8
–0.6
–0.4
–0.2
0.0
0.2
0.5
0.0
–0.5
–1.0
–1.5
Figure 10. Composite Output
Differential Phase and Gain, NTSC
1ST
2ND
3RD
4TH
5TH
6TH
0.00
–0.14
–0.32
–0.16
0.04
0.10
0.00
–1.01
–1.18
–0.44
0.42
0.70
DG DP (PAL) (SYNC = EXT)
LINE = 25, 700mV RAMP
DIFFERENTIAL GAIN (%)
DIFFERENTIAL PHASE (deg)
MIN = –0.32
MAX = 0.10
pk–pk = 0.42
MIN = –1.18
MAX = 0.70
pk–pk = 1.89
0.2
0.1
0.0
–0.2
–0.4
–0.5
0.3
–0.3
–0.1
1.5
1.0
0.5
0.0
–0.5
–1.0
–1.5
–2.0
Figure 11. Composite Output
Differential Phase and Gain, PAL
9.72 s
5.49 s
4.59 s
39.7 IRE
33.8 IRE
H TIMING MEASUREMENT RS–170A (NTSC)
FIELD = 1 LINE = 22
124ns
100ns
9.0
CYCLES
AVERAGE
256
Figure 12. Horizontal Timing, NTSC
5.59 s
AVERAGE
256
102ns
94ns
2.28 s
4.60 s
293.5mV
249.0mV
H TIMING (PAL)
LINE = 25
Figure 13. Horizontal Timing, PAL
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PDF描述
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