tC 10 1000 " />
參數(shù)資料
型號： AD676-EB
廠商： Analog Devices Inc
文件頁數(shù)： 11/16頁
文件大?。?/td> 0K
描述： BOARD EVAL SAMPLING ADC AD676
標準包裝： 1
ADC 的數(shù)量： 1
位數(shù)： 16
采樣率（每秒）： 100k
數(shù)據(jù)接口： 并聯(lián)
輸入范圍： ±VREF
在以下條件下的電源（標準）： 360mW @ 100kSPS
工作溫度： 0°C ~ 70°C
已用 IC / 零件： AD676
已供物品： 板
相關產(chǎn)品： AD676JDZ-ND - IC ADC 16BIT SAMPLING 28-CDIP
AD676KN-ND - IC ADC 16BIT SAMPLING 28-DIP
AD676BD-ND - IC ADC 16BIT SAMPLING 28-CDIP
AD676AD-ND - IC ADC 16BIT SAMPLING 28-CDIP
AD676KD-ND - IC ADC 16BIT 100KSPS 28-CDIP
AD676JN-ND - IC ADC 16BIT 100KSPS 28-DIP
AD676JD-ND - IC ADC 16BIT SAMPLING 28-CDIP
AD676
REV. A
–4–
TIMING SPECIFICATIONS
Parameter
Symbol
Min
Typ
Max
Units
Conversion Time
2
tC
10
1000
s
CLK Period
3
tCLK
480
ns
Calibration Time
tCT
85,530
tCLK
Sampling Time (Included in tC)tS
2
s
CAL to BUSY Delay
tCALB
75
150
ns
BUSY to SAMPLE Delay
tBS
2
s
SAMPLE to BUSY Delay
tSB
15
100
ns
CLK HIGH
4
tCH
50
ns
CLK LOW
4
tCL
50
ns
SAMPLE LOW to 1st CLK Delay
tSC
50
ns
SAMPLE LOW
tSL
100
ns
Output Delay
tOD
125
200
ns
Status Delay
tSD
50
ns
CAL HIGH Time
tCALH
50
ns
NOTES
1See the “CONVERSION CONTROL” and “AUTOCALIBRATION” sections for detailed explanations of the above timing.
2Depends upon external clock frequency; includes acquisition time and conversion time. The maximum conversion time is specified to account for the droop of the
internal sample/hold function. Longer conversion times may degrade performance. See “General Conversion Guidelines” for additional explanation of maximum con-
version time.
3580 ns is recommended for optimal accuracy over temperature.
4t
CH + tCL = tCLK and must be greater than 480 ns.
CAL
BUSY
CLK
t
CH
t
CL
t
CLK
tCALB
t
OD
t
CT
CALH
t
Figure 1. Calibration Timing
SAMPLE
(INPUT)
CLK
(INPUT)
BIT 1 – BIT 16
(OUTPUTS)
BUSY
(OUTPUT)
1
234
5
t
S
t
SL
t
SC
t
CLK
t
CL
t
CH
t
OD
t
SD
t
SB
t
BS
t
C
13
14
15
16
17
(PREVIOUS CONVERSION)
(NEW DATA)
Figure 2a. General Conversion Timing
SAMPLE
(INPUT)
CLK
(INPUT)
BIT 1 – BIT 16
(OUTPUTS)
BUSY
(OUTPUT)
1
234
5
t
S
t
SL
t
SC
t
CLK
t
CL
t
CH
t
OD
t
SD
t
SB
t
BS
t
C
13
14
15
16
17
t
S
(PREVIOUS CONVERSION)
(NEW DATA)
Figure 2b. Continuous Conversion Timing
(TMIN to TMAX VCC = +12 V
5%, VEE = –12 V
5%, VDD = +5 V
10%, VREF = 10.0 V)
1
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PDF描述
AD9211-200EBZ BOARD EVAL FOR AD9211-200
HW-V5-ML521-UNI-G-J EVALUATION PLATFORM VIRTEX-5
HW-V4-ML423-UNI-G-J EVALUATION PLATFORM VIRTEX-4
GCM22DRPS CONN EDGECARD 44POS DIP .156 SLD
AD9219-65EBZ BOARD EVALUATION FOR AD9219
相關代理商/技術參數(shù)
參數(shù)描述
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AD676JDZ# 制造商:Analog Devices 功能描述:
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