參數資料
型號： AD5734AREZ
廠商： Analog Devices Inc
文件頁數： 18/32頁
文件大?。?/td> 0K
描述： IC DAC 14BIT DSP/SRL 24TSSOP
產品培訓模塊： Data Converter Fundamentals
DAC Architectures
設計資源： Software Configurable 14-Bit Quad-Channel Unipolar/Bipolar Voltage Output Using AD5734 (CN0087)
標準包裝： 1
設置時間： 10µs
位數： 14
數據接口： DSP，MICROWIRE?，QSPI?，串行，SPI?
轉換器數目： 4
電壓電源： 模擬和數字，雙 ±
功率耗散（最大）： 310mW
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 24-TSSOP（0.173"，4.40mm）裸露焊盤
供應商設備封裝： 24-TSSOP 裸露焊盤
包裝： 管件
輸出數目和類型： 4 電壓，單極；4 電壓，雙極
采樣率（每秒）： 100k
AD5724/AD5734/AD5754
Rev. D | Page 25 of 32
OUTPUT RANGE SELECT REGISTER
The output range select register is addressed by setting the three REG bits to 001. The DAC address bits select the DAC channel and the
range bits (R2, R1, R0) select the required output range (see Table 21 and Table 22).
Table 21. Programming the Required Output Range
MSB
LSB
R/W
Zero
REG2
REG1
REG0
A2
A1
A0
DB15 to DB3
DB2
DB1
DB0
0
1
DAC address
Don’t care
R2
R1
R0
Table 22. Output Range Options
R2
R1
R0
Output Range (V)
0
+5
0
1
+10
0
1
0
+10.8
0
1
±5
1
0
±10
1
0
1
±10.8
CONTROL REGISTER
The control register is addressed by setting the three REG bits to 011. The value written to the address and data bits determines the
control function selected. The control register options are shown in Table 23 and Table 24.
Table 23. Programming the Control Register
MSB
LSB
R/W
Zero
REG2
REG1
REG0
A2
A1
A0
DB15 to DB4
DB3
DB2
DB1
DB0
0
1
0
NOP, data = don’t care
0
1
0
1
Don’t care
TSD enable
Clamp enable
CLR select
SDO disable
0
1
0
Clear, data = don’t care
0
1
0
1
Load, data = don’t care
Table 24. Explanation of Control Register Options
Option
Description
NOP
No operation instruction used in readback operations.
Clear
Addressing this function sets the DAC registers to the clear code and updates the outputs.
Load
Addressing this function updates the DAC registers and, consequently, the DAC outputs.
SDO Disable
Set by the user to disable the SDO output. Cleared by the user to enable the SDO output (default).
CLR Select
See Table 25 for a description of the CLR select operation.
Clamp Enable
Set by the user to enable the current-limit clamp. The channel does not power down upon detection of an
overcurrent; the current is clamped at 20 mA (default).
Cleared by the user to disable the current-limit clamp. The channel powers down upon detection of an overcurrent.
TSD Enable
Set by the user to enable the thermal shutdown feature. Cleared by the user to disable the thermal shutdown
feature (default).
Table 25. CLR Select Options
Output CLR Value
CLR Select Setting
Unipolar Output Range
Bipolar Output Range
0
0 V
1
Midscale
Negative full scale
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PDF描述
VI-214-MW-F4 CONVERTER MOD DC/DC 48V 100W
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參數描述
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AD5734R 制造商:AD 制造商全稱:Analog Devices 功能描述:Complete, Quad, 12-/14-/16-Bit, Serial Input, Unipolar/Bipolar Voltage Output DACs
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AD5734RBREZ-REEL7 功能描述:IC DAC 14BIT DSP/SRL 24TSSOP RoHS:是 類別:集成電路 (IC) >> 數據采集 - 數模轉換器 系列:- 產品培訓模塊:Data Converter Fundamentals DAC Architectures 標準包裝:750 系列:- 設置時間:7µs 位數:16 數據接口:并聯(lián) 轉換器數目:1 電壓電源:雙 ± 功率耗散（最大）:100mW 工作溫度:0°C ~ 70°C 安裝類型:表面貼裝 封裝/外殼:28-LCC（J 形引線） 供應商設備封裝:28-PLCC（11.51x11.51） 包裝:帶卷 (TR) 輸出數目和類型:1 電壓，單極；1 電壓，雙極 采樣率（每秒）:143k
AD5735 制造商:AD 制造商全稱:Analog Devices 功能描述:Quad Channel, 16-Bit, Serial Input, 4-20mA & Voltage Output DAC, Dynamic Power Control
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