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參數(shù)資料
型號: AD5439YRUZ-REEL7
廠商: Analog Devices Inc
文件頁數(shù): 27/29頁
文件大小: 0K
描述: IC DAC DUAL 10BIT MULT 16TSSOP
產(chǎn)品培訓(xùn)模塊: Data Converter Fundamentals
DAC Architectures
標(biāo)準包裝: 1,000
設(shè)置時間: 35ns
位數(shù): 10
數(shù)據(jù)接口: 串行
轉(zhuǎn)換器數(shù)目: 2
電壓電源: 單電源
功率耗散(最大): 3.5µW
工作溫度: -40°C ~ 125°C
安裝類型: 表面貼裝
封裝/外殼: 16-TSSOP(0.173",4.40mm 寬)
供應(yīng)商設(shè)備封裝: 16-TSSOP
包裝: 帶卷 (TR)
輸出數(shù)目和類型: 4 電流,單極;4 電流,雙極
采樣率(每秒): 2.47M
其它名稱: AD5439YRUZ-REEL7TR
AD5429/AD5439/AD5449
Data Sheet
Rev. E | Page 6 of 28
04464-
003
t8
t7
t12
t1
t3
t2
t4
t5
t6
DB15
(N)
DB15
(N + 1)
DB0
(N)
DB0
(N + 1)
DB15
(N)
DB0
(N)
SCLK
SYNC
SDIN
SDO
NOTES
1. ALTERNATIVELY, DATA CAN BE CLOCKED INTO THE INPUT SHIFT REGISTER ON THE RISING EDGE OF SCLK AS
DETERMINED BY THE CONTROL BITS. IN THIS CASE, DATA WOULD BE CLOCKED OUT OF SDO ON THE FALLING
EDGE OF SCLK. TIMING IS AS ABOVE, WITH SCLK INVERTED.
Figure 3. Daisy-Chain Timing Diagram
SDO
SDIN
SYNC
SCLK
16
32
DB15
DB0
DB15
DB0
DB15
UNDEFINED
NOP CONDITION
DB0
INPUT WORD SPECIFIES
REGISTER TO BE READ
SELECTED REGISTER DATA
CLOCKED OUT
04464-
059
Figure 4. Readback Mode Timing Diagram
200
A
IOL
200
A
IOH
TO OUTPUT
PIN
CL
50pF
VOH (MIN) + VOL (MAX)
2
04464-004
Figure 5. Load Circuit for SDO Timing Specifications
相關(guān)PDF資料
PDF描述
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AD5440YRU-REEL 功能描述:IC DAC 10BIT MULTIPLYING 24TSSOP RoHS:否 類別:集成電路 (IC) >> 數(shù)據(jù)采集 - 數(shù)模轉(zhuǎn)換器 系列:- 產(chǎn)品培訓(xùn)模塊:LTC263x 12-, 10-, and 8-Bit VOUT DAC Family 特色產(chǎn)品:LTC2636 - Octal 12-/10-/8-Bit SPI VOUT DACs with 10ppm/°C Reference 標(biāo)準包裝:91 系列:- 設(shè)置時間:4µs 位數(shù):10 數(shù)據(jù)接口:MICROWIRE?,串行,SPI? 轉(zhuǎn)換器數(shù)目:8 電壓電源:單電源 功率耗散(最大):2.7mW 工作溫度:-40°C ~ 85°C 安裝類型:表面貼裝 封裝/外殼:14-WFDFN 裸露焊盤 供應(yīng)商設(shè)備封裝:14-DFN-EP(4x3) 包裝:管件 輸出數(shù)目和類型:8 電壓,單極 采樣率(每秒):*
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