參數(shù)資料
型號： AD1852JRSZRL
廠商： Analog Devices Inc
文件頁數(shù)： 16/20頁
文件大?。?/td> 0K
描述： IC DAC STEREO 24BIT 28-SSOP
產(chǎn)品培訓模塊： Data Converter Fundamentals
DAC Architectures
標準包裝： 1,500
位數(shù)： 24
數(shù)據(jù)接口： DSP，I²S，串行，SPI?
轉(zhuǎn)換器數(shù)目： 2
電壓電源： 模擬和數(shù)字
功率耗散（最大）： 265mW
工作溫度： 0°C ~ 70°C
安裝類型： 表面貼裝
封裝/外殼： 28-SSOP（0.209"，5.30mm 寬）
供應商設備封裝： 28-SSOP
包裝： 帶卷 (TR)
輸出數(shù)目和類型： 4 電壓，單極
采樣率（每秒）： 192k
AD1852
Rev. A | Page 5 of 20
DIGITAL TIMING
Guaranteed over 0°C to 70°C, AVDD = DVDD = 5.0 V × 10%.
Table 8.
Parameter
Description
Min
Unit
tDMP
MCLK period (fMCLK = 256 × fLRCLK)1
54
ns
tDML
MCLK low pulse width (all modes)
0.4 × tDMP
ns
tDMH
MCLK high pulse width (all modes)
0.4 × tDMP
ns
tDBH
BCLK high pulse width (see Figure 26)
20
ns
tDBL
BCLK low pulse width (see Figure 26)
20
ns
tDBP
BCLK period (see Figure 26)
60
ns
tDLS
LRCLK setup (see Figure 26)
20
ns
tDLH
LRCLK hold (DSP serial port mode only)
5
ns
tDDS
SDATA setup (see Figure 26)
5
ns
tDDH
SDATA hold (see Figure 26)
10
ns
tRSTL
RESET low pulse width
15
ns
1 Higher MCLK frequencies are allowable when using the on-chip master clock autodivide feature.
相關PDF資料
PDF描述
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相關代理商/技術參數(shù)
參數(shù)描述
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AD1853JRSRL 制造商:Analog Devices 功能描述:DAC 2-CH Delta-Sigma 24-bit 28-Pin SSOP T/R 制造商:Rochester Electronics LLC 功能描述:STEREO, 192KHZ MULTIBIT SIGMA DELTA DAC - Bulk
AD1853JRSZ 功能描述:IC DAC STEREO 24BIT 28SSOP RoHS:是 類別:集成電路 (IC) >> 數(shù)據(jù)采集 - 數(shù)模轉(zhuǎn)換器 系列:- 標準包裝:1 系列:- 設置時間:4.5µs 位數(shù):12 數(shù)據(jù)接口:串行，SPI? 轉(zhuǎn)換器數(shù)目:1 電壓電源:單電源 功率耗散（最大）:- 工作溫度:-40°C ~ 125°C 安裝類型:表面貼裝 封裝/外殼:8-SOIC（0.154"，3.90mm 寬） 供應商設備封裝:8-SOICN 包裝:剪切帶 (CT) 輸出數(shù)目和類型:1 電壓，單極；1 電壓，雙極 采樣率（每秒）:* 其它名稱:MCP4921T-E/SNCTMCP4921T-E/SNRCTMCP4921T-E/SNRCT-ND
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