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參數(shù)資料
| 型號： | A623308V-70SU |
| 廠商： | AMIC Technology Corporation |
| 英文描述： | 8K X 8 BIT CMOS SRAM |
| 中文描述： | 8K的× 8位CMOS的SRAM |
| 文件頁數(shù)： | 10/13頁 |
| 文件大小： | 130K |
| 代理商： | A623308V-70SU |
A623308 Series
PRELIMINARY
(December, 2002, Version 0.3)
9
AMIC Technology, Corp.
AC Test Conditions
Input Pulse Levels
0V, 3.0V
Input Rise And Fall Time
5 ns
Input and Output Timing Reference Levels
1.5V
Output Load
See Figure 1,2
30pF
*
* Including scope and jig.
C
L
* Including scope and jig.
I/O
+5V
990
1800
5pF
*
C
L
I/O
+5V
990
1800
Data Retention Characteristics
(T
A
= 0
°
C to +70
°
C, -25
°
C to +85
°
C or -40
°
C to +85
°
C)
Figure 1. Output Load
Figure 2. Output Load for t
CLZ
t
OLZ
,
t
CHZ
,
t
OHZ
,
t
WHZ
, and
t
ow
Symbol
Parameter
Min.
Max.
Unit
Conditions
V
DR
VCC for Data Retention
2.0
5.5
V
CE
≥
VCC - 0.2V
I
CCDR
Data Retention Current
-
3
μ
A
VCC = 2.0V,
CE
≥
VCC - 0.2V
V
IN
≥
0V
t
CDR
Chip Disable to Data Retention Time
0
-
ns
t
R
Operation Recovery Time
t
RC
-
ns
See Retention Waveform
Low VCC Data Retention Waveform
VCC
t
CDR
V
IH
4.5V
t
R
V
IH
4.5V
DATA RETENTION MODE
VDR
≥
2.0V
CE
≥
VDR - 0.2V
CE
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| A623308SERIES | 8K X 8 BIT CMOS SRAM |
| A625308-L | 32K X 8 BIT CMOS SRAM |
| A625308M | 32K X 8 BIT CMOS SRAM |
| A625308M-70L | 32K X 8 BIT CMOS SRAM |
| A625308R | 32K X 8 BIT CMOS SRAM |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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