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參數(shù)資料
| 型號： | A43P26161G-95U |
| 廠商： | AMIC Technology Corporation |
| 英文描述： | 1M X 16 Bit X 4 Banks Low Power Synchronous DRAM |
| 中文描述： | 100萬× 16位× 4個銀行的低功耗同步DRAM |
| 文件頁數(shù)： | 15/44頁 |
| 文件大?。?/td> | 1122K |
| 代理商： | A43P26161G-95U |
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Basic feature And Function Descriptions
A43P26161
PRELIMINARY
(July, 2005, Version 1.1)
14
AMIC Technology, Corp.
1) Click Suspended During Write (BL=4)
Masked by CKE
Q0
Q1
Q3
Q0
Q2
Q3
Suspended Dout
2) Clock Suspended During Read (BL=4)
WR
Masked by CKE
D0
D1
D2
D3
D0
D1
D2
D3
Not Written
DQ(CL3)
DQ(CL2)
Internal
CLK
CKE
CMD
CLK
RD
Q2
Q1
Note: CLK to CLK disable/enable=1 clock
1. CLOCK Suspend
2. DQM Operation
* Note :
1. DQM makes data out Hi-Z after 2 clocks which should masked by CKE “L”.
2. DQM masks both data-in and data-out.
1) Write Mask (BL=4)
Masked by CKE
Q0
Q2
Q3
Q1
Q2
Q3
DQM to Data-out Mask = 2
2) Read Mask (BL=4)
WR
Masked by CKE
D0
D1
D3
D0
D1
D3
DQM to Data-in Mask = 0CLK
DQ(CL3)
DQ(CL2)
DQM
CMD
CLK
RD
Hi-Z
Hi-Z
Q0
Q2
Q4
2) Read Mask (BL=4)
RD
Hi-Z
Hi-Z
Hi-Z
Q6
Q7
Q8
Hi-Z
Q1
Q3
Hi-Z
Hi-Z
Q5
Q6
Q7
CLK
CMD
CKE
DQM
DQ(CL2)
DQ(CL3)
相關PDF資料 |
PDF描述 |
|---|---|
| A43P26161G-95UF | 1M X 16 Bit X 4 Banks Low Power Synchronous DRAM |
| A43P26161V | 1M X 16 Bit X 4 Banks Low Power Synchronous DRAM |
| A43P26161V-75 | 1M X 16 Bit X 4 Banks Low Power Synchronous DRAM |
| A43P26161V-75F | 1M X 16 Bit X 4 Banks Low Power Synchronous DRAM |
| A43P26161V-75U | 1M X 16 Bit X 4 Banks Low Power Synchronous DRAM |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| A43P26161G-95UF | 制造商:AMICC 制造商全稱:AMIC Technology 功能描述:1M X 16 Bit X 4 Banks Low Power Synchronous DRAM |
| A43P26161V | 制造商:AMICC 制造商全稱:AMIC Technology 功能描述:1M X 16 Bit X 4 Banks Low Power Synchronous DRAM |
| A43P26161V-75 | 制造商:AMICC 制造商全稱:AMIC Technology 功能描述:1M X 16 Bit X 4 Banks Low Power Synchronous DRAM |
| A43P26161V-75F | 制造商:AMICC 制造商全稱:AMIC Technology 功能描述:1M X 16 Bit X 4 Banks Low Power Synchronous DRAM |
| A43P26161V-75U | 制造商:AMICC 制造商全稱:AMIC Technology 功能描述:1M X 16 Bit X 4 Banks Low Power Synchronous DRAM |
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