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參數(shù)資料
| 型號： | A43L4616V-7 |
| 廠商： | AMIC Technology Corporation |
| 英文描述： | 4M X 16 Bit X 4 Banks Synchronous DRAM |
| 中文描述： | 4米× 16位× 4個銀行同步DRAM |
| 文件頁數(shù)： | 27/41頁 |
| 文件大?。?/td> | 1063K |
| 代理商： | A43L4616V-7 |
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A43L4616
(September, 2004, Version 0.0)
26
AMIC Technology, Corp.
Page Read Cycle at Different Bank @Burst Length = 4
Read
(C-Bank)
Row Active
(D-Bank)
Read
(B-Bank)
Read
(A-Bank)
High
0
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
CLOCK
CKE
CS
RAS
CAS
ADDR
BS1
Row Active
(A-Bank)
Row Active
(B-Bank)
: Don't care
RAa
RBb
A10/AP
CBb
Row Active
(C-Bank)
*Note 1
*Note 2
CAa
RAa
WE
DQM
QBb2
QBb1
QAa0
QAa1
QAa2
QBb0
QCc0
QCc1
QCc2
QDd0
QDd1
QDd2
QBb2
QBb1
QAa0
QAa1
QAa2
QBb0
QCc0
QCc1
QCc2
QDd0
QDd1
QDd2
Read
(D-Bank)
Precharge
(C-Bank)
Precharge
(D-Bank)
DQ
(CL=2)
DQ
(CL=3)
BS0
RBb
RCc
RDd
Precharge
(A-Bank)
Precharge
(B-Bank)
RCc
CCc
RDd
CDd
* Note : 1.
CS
can be don’t care when
RAS
,
CAS
and
WE
are high at the clock high going edge.
2. To interrupt a burst read by row precharge, both the read ad the precharge banks must be the same.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| A43L8316AV-5 | 128K X 16 Bit X 2 Banks Synchronous DRAM |
| A43L8316AV-5.5 | 128K X 16 Bit X 2 Banks Synchronous DRAM |
| A43L8316AV-6 | 128K X 16 Bit X 2 Banks Synchronous DRAM |
| A43L8316AV-7 | 128K X 16 Bit X 2 Banks Synchronous DRAM |
| A43L8316A | 128K X 16 Bit X 2 Banks Synchronous DRAM |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| A43L4616V-75I | 制造商:AMICC 制造商全稱:AMIC Technology 功能描述:1M X 16 Bit X 4 Banks Synchronous DRAM |
| A43L4616V-95I | 制造商:AMICC 制造商全稱:AMIC Technology 功能描述:1M X 16 Bit X 4 Banks Synchronous DRAM |
| A43L4632G-75I | 制造商:AMICC 制造商全稱:AMIC Technology 功能描述:1M X 16 Bit X 4 Banks Synchronous DRAM |
| A43L4632G-95I | 制造商:AMICC 制造商全稱:AMIC Technology 功能描述:1M X 16 Bit X 4 Banks Synchronous DRAM |
| A43L4632V-75I | 制造商:AMICC 制造商全稱:AMIC Technology 功能描述:1M X 16 Bit X 4 Banks Synchronous DRAM |
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