Revision 11 2-13 Figure 2-3 Input Buffer Timing Model and Delays (example) t
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    參數(shù)資料
    型號: A3PN030-Z1VQ100I
    廠商: Microsemi SoC
    文件頁數(shù): 35/114頁
    文件大小: 0K
    描述: IC FPGA NANO 30K GATES 100-VQFP
    標準包裝: 90
    系列: ProASIC3 nano
    輸入/輸出數(shù): 77
    門數(shù): 30000
    電源電壓: 1.425 V ~ 1.575 V
    安裝類型: 表面貼裝
    工作溫度: -40°C ~ 85°C
    封裝/外殼: 100-TQFP
    供應(yīng)商設(shè)備封裝: 100-VQFP(14x14)
    ProASIC3 nano Flash FPGAs
    Revision 11
    2-13
    Figure 2-3 Input Buffer Timing Model and Delays (example)
    tPY
    (R)
    PAD
    Y
    Vtrip
    GND
    tPY
    (F)
    Vtrip
    50%
    VIH
    VCC
    VIL
    tDIN
    (R)
    DIN
    GND
    tDIN
    (F)
    50%
    VCC
    PAD
    Y
    tPY
    D
    CLK
    Q
    I/O Interface
    DIN
    tDIN
    To Array
    tPY = MAX(tPY(R), tPY(F))
    tDIN = MAX(tDIN(R), tDIN(F))
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    PDF描述
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