- 您現(xiàn)在的位置：買(mǎi)賣(mài)IC網(wǎng) > PDF目錄24629 > 92HD81B1C5NLGXUAX8 (INTEGRATED DEVICE TECHNOLOGY INC) PCM CODEC, QCC48 PDF資料下載
參數(shù)資料
| 型號(hào)： | 92HD81B1C5NLGXUAX8 |
| 廠(chǎng)商： | INTEGRATED DEVICE TECHNOLOGY INC |
| 元件分類(lèi)： | 編解碼器 |
| 英文描述： | PCM CODEC, QCC48 |
| 封裝： | ROHS COMPLIANT, QFN-48 |
| 文件頁(yè)數(shù)： | 220/289頁(yè) |
| 文件大?。?/td> | 3502K |
| 代理商： | 92HD81B1C5NLGXUAX8 |
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IDT CONFIDENTIAL
36
V 0.987 11/09
2009 INTEGRATED DEVICE TECHNOLOGY, INC.
92HD81
SINGLE CHIP PC AUDIO SYSTEM, CODEC+SPEAKER AMPLIFIER+CAPLESS HP+LDO
2.22. Aux Audio Support
See Orderable Part Numbers for which codecs offer this feature.
The codec supports an auxiliary audio mode where analog audio is supported by default after power
is supplied with the HD Audio bus disabled. In this mode, an analog input is routed to one of several
output ports depending on jack presence detection.
2.22.1. General conditions in Aux Audio Mode:
HD Audio Link is off (RST# is 0, active, and BitClk is 0, inactive. CODEC does not need to mon-
itor BitClk to enter/exit this mode but must not depend on BitClk to operate.)
HD Audio CODEC analog and digital supplies are active.
Port A may be an optional headphone jack (Normal and Aux Audio Mode) or an internal micro-
phone port (Normal Mode only / 92HD81 only)
Port B connects to the system headphone jack.
Port D connects to the internal speakers.
Port E is AUX Audio out
Port F is AUX Audio In
The internal digital microphone clock is controlled by a source external to the CODEC and the
CODEC will use the DMIC_CLK pin as a clock input. The DMIC0 input is used to process 1 or 2
digital microphone inputs. The expected clock is 3.072MHz.
EAPD is used to control the power state of the mixer, BTL amplifier, and headphone amplifiers.
The amplifiers are off if EAPD is held low.
Internal circuitry will delay enabling (change power state, un-mute, etc.) the output amplifiers a
sufficient amount of time after the application of power or EAPD=1 to prevent pops.
Internal circuitry will orchestrate power down (EAPD = 0) to prevent pops.
EAPD must be forced low before removing power.
ECR15b considerations: Clock Stop OK or similar communication will be used to prevent prob-
lems when an OS driver attempts to put the HD Audio bus controller into D3 to save power. The
bus must not be placed into reset with the clock stopped or unless EAPD is forced low or D3cold
has been set. The Enable bit in the Aux Audio vendor specific verb is provided so firmware or
other software can disable Aux Audio support and allow stopping the HD Audio bus when an OS
is in an active state. The default value of this bit is determined by a bond option and may be
determined by reading the device ID. This bit only returns to its default value when a power on
reset event is generated.
2.22.2. “Playback Path” Port Behavior
Port F (Aux Audio In) input is routed to Port D (“internal speakers”), Ports A&B (system headphone
ports), and Port E (Aux Audio Out) through the analog mixer.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| 92HD81B1C5NLGXUAX | PCM CODEC, QCC48 |
| 92HD81B1C5NLGXYDX8 | PCM CODEC, QCC48 |
| 92HD81B1C5NLGXYDX | PCM CODEC, QCC48 |
| 92HD81B1X5NLGXTAX8 | PCM CODEC, QCC48 |
| 92HD81B1X5NLGXTAX | PCM CODEC, QCC48 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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| 92HD81B1C5NLGXWAX | 制造商:Integrated Device Technology Inc 功能描述:AUD CODEC 2ADC / 2DAC 24BIT 48PIN VFQFPN - Bulk |
| 92HD81B1C5NLGXWAX8 | 制造商:Integrated Device Technology Inc 功能描述:AUD CODEC 2ADC / 2DAC 24BIT 48PIN VFQFPN - Tape and Reel |
| 92HD81B1C5NLGXYBX | 制造商:Integrated Device Technology Inc 功能描述:92HD81B1C5NLGXYBX - Bulk |
| 92HD81B1C5NLGXYBX8 | 制造商:Integrated Device Technology Inc 功能描述:92HD81B1C5NLGXYBX8 - Tape and Reel |
| 92HD81B1C5NLGXYCX | 制造商:Integrated Device Technology Inc 功能描述:AUD CODEC 2ADC / 2DAC 24BIT 48PIN VFQFPN - Bulk |
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