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              參數(shù)資料
              型號: 79RC32K438233BB
              廠商: INTEGRATED DEVICE TECHNOLOGY INC
              元件分類: 微控制器/微處理器
              英文描述: IDTTM InterpriseTM Integrated Communications Processor
              中文描述: 32-BIT, 233 MHz, RISC PROCESSOR, PBGA416
              封裝: 27 X 27 MM, PLASTIC, BGA-416
              文件頁數(shù): 12/59頁
              文件大小: 644K
              代理商: 79RC32K438233BB
              第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁當(dāng)前第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁
              12 of 59
              May 25, 2004
              IDT 79RC32438
              Pin Characteristics
              Note:
              Some input pads of the RC32438 do not contain internal pull-ups or pull-downs. Unused inputs should be tied off to appropriate
              levels. This is especially critical for unused control signal inputs (such as BRN) which, if left floating, could adversely affect the RC32438’s
              operation. Also, any input pin left floating can cause a slight increase in power consumption.
              JTAG_TRST_N
              I
              JTAG Reset
              . This active low signal asynchronously resets the boundary scan
              logic, JTAG TAP Controller, and the EJTAG Debug TAP Controller. An external
              pull-up on the board is recommended to meet the JTAG specification in cases
              where the tester can access this signal. However, for systems running in func-
              tional mode, one of the following should occur:
              1) actively drive this signal low with control logic
              2) statically drive this signal low with an external pull-down on the board
              3) clock JTAG_TCK while holding EJTAG_TMS and/or JTAG_TMS high.
              Debug
              CPU
              O
              CPU Transaction.
              This signal is asserted during all CPU instruction fetches and
              data transfers to/from the DDR and devices on the memory and peripheral bus.
              The signal is negated during PCI and DMA transactions to/from the DDR and
              devices on the memory and peripheral bus.
              INST
              O
              Instruction or Data.
              This signal is driven high during CPU instruction fetches on
              the memory and peripheral bus memory or DDR bus.
              Function
              Pin Name
              Type
              Buffer
              I/O Type
              Internal
              Resistor
              Notes
              1
              Memory and
              Peripheral Bus
              BDIRN
              O
              LVTTL
              High Drive
              BGN
              O
              LVTTL
              Low Drive
              BOEN
              O
              LVTTL
              High Drive
              BRN
              I
              LVTTL
              STI
              2
              pull-up
              BWEN[1:0]
              O
              LVTTL
              High Drive
              CSN[5:0]
              O
              LVTTL
              High Drive
              MADDR[21:0]
              O
              LVTTL
              High Drive
              MDATA[15:0]
              I/O
              LVTTL
              High Drive
              OEN
              O
              LVTTL
              High Drive
              RWN
              O
              LVTTL
              High Drive
              WAITACKN
              I
              LVTTL
              STI
              pull-up
              Table 2 Pin Characteristics (Part 1 of 4)
              Signal
              Type
              Name/Description
              Table 1 Pin Description (Part 9 of 9)
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              79RC32K438233BBI IDTTM InterpriseTM Integrated Communications Processor
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              79RC32K438300BB IDTTM InterpriseTM Integrated Communications Processor
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              相關(guān)代理商/技術(shù)參數(shù)
              參數(shù)描述
              79RC32K438-233BB 功能描述:處理器 - 專門應(yīng)用 RoHS:否 制造商:Freescale Semiconductor 類型:Multimedia Applications 核心:ARM Cortex A9 處理器系列:i.MX6 數(shù)據(jù)總線寬度:32 bit 最大時鐘頻率:1 GHz 指令/數(shù)據(jù)緩存: 數(shù)據(jù) RAM 大小:128 KB 數(shù)據(jù) ROM 大小: 工作電源電壓: 最大工作溫度:+ 95 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:MAPBGA-432
              79RC32K438-233BBG 功能描述:處理器 - 專門應(yīng)用 RoHS:否 制造商:Freescale Semiconductor 類型:Multimedia Applications 核心:ARM Cortex A9 處理器系列:i.MX6 數(shù)據(jù)總線寬度:32 bit 最大時鐘頻率:1 GHz 指令/數(shù)據(jù)緩存: 數(shù)據(jù) RAM 大小:128 KB 數(shù)據(jù) ROM 大小: 工作電源電壓: 最大工作溫度:+ 95 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:MAPBGA-432
              79RC32K438-233BBGI 功能描述:處理器 - 專門應(yīng)用 RoHS:否 制造商:Freescale Semiconductor 類型:Multimedia Applications 核心:ARM Cortex A9 處理器系列:i.MX6 數(shù)據(jù)總線寬度:32 bit 最大時鐘頻率:1 GHz 指令/數(shù)據(jù)緩存: 數(shù)據(jù) RAM 大小:128 KB 數(shù)據(jù) ROM 大小: 工作電源電壓: 最大工作溫度:+ 95 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:MAPBGA-432
              79RC32K438233BBI 制造商:IDT 制造商全稱:Integrated Device Technology 功能描述:IDTTM InterpriseTM Integrated Communications Processor
              79RC32K438-233BBI 功能描述:處理器 - 專門應(yīng)用 RoHS:否 制造商:Freescale Semiconductor 類型:Multimedia Applications 核心:ARM Cortex A9 處理器系列:i.MX6 數(shù)據(jù)總線寬度:32 bit 最大時鐘頻率:1 GHz 指令/數(shù)據(jù)緩存: 數(shù)據(jù) RAM 大小:128 KB 數(shù)據(jù) ROM 大小: 工作電源電壓: 最大工作溫度:+ 95 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:MAPBGA-432
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