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參數(shù)資料
| 型號(hào)： | 74LVC2G74DP,125 |
| 廠商： | NXP Semiconductors |
| 文件頁數(shù)： | 3/20頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC SNGL D FF POS-EDG TRIG 8TSSOP |
| 產(chǎn)品培訓(xùn)模塊： | Logic Packages |
| 標(biāo)準(zhǔn)包裝： | 1 |
| 系列： | 74LVC |
| 功能： | 設(shè)置（預(yù)設(shè)）和復(fù)位 |
| 類型： | D 型 |
| 輸出類型： | 差分 |
| 元件數(shù)： | 1 |
| 每個(gè)元件的位元數(shù)： | 1 |
| 頻率 - 時(shí)鐘： | 200MHz |
| 延遲時(shí)間 - 傳輸： | 2.5ns |
| 觸發(fā)器類型： | 正邊沿 |
| 輸出電流高，低： | 32mA，32mA |
| 電源電壓： | 1.65 V ~ 5.5 V |
| 工作溫度： | -40°C ~ 125°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 8-TSSOP，8-MSOP（0.118"，3.00mm 寬） |
| 包裝： | 標(biāo)準(zhǔn)包裝 |
| 其它名稱： | 568-7681-6 |
74LVC2G74
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NXP B.V. 2013. All rights reserved.
Product data sheet
Rev. 10 — 2 April 2013
11 of 25
NXP Semiconductors
74LVC2G74
Single D-type flip-flop with set and reset; positive edge trigger
12. Waveforms
Measurement points are given in Table 10.
The shaded areas indicate when the input is permitted to change for predictable output performance.
VOL and VOH are typical output voltage levels that occur with the output load.
Fig 8.
The clock input (CP) to output (Q, Q) propagation delays, the clock pulse width, the D to CP set-up, the
CP to D hold times and the CP maximum frequency
mnb141
th
tsu
th
tPHL
tPLH
tsu
1/fmax
tW
VI
GND
VM
VI
GND
CP input
D input
VOH
VOL
Q output
VOH
VOL
Q output
Table 10.
Measurement points
Supply voltage
Input
Output
VCC
VM
1.65 V to 1.95 V
0.5
V
CC
0.5
V
CC
2.3 V to 2.7 V
0.5
V
CC
0.5
V
CC
2.7V
1.5V
3.0V to 3.6V
1.5V
4.5 V to 5.5 V
0.5
V
CC
0.5
V
CC
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PDF描述 |
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