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參數(shù)資料
| 型號： | 74LCX573BQX |
| 廠商： | Fairchild Semiconductor |
| 文件頁數(shù)： | 4/14頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC LATCH LV OCTAL 5V I O 20-DQFN |
| 標準包裝： | 3,000 |
| 系列： | 74LCX |
| 邏輯類型： | D 型透明鎖存器 |
| 電路： | 8:8 |
| 輸出類型： | 三態(tài) |
| 電源電壓： | 2 V ~ 3.6 V |
| 獨立電路： | 1 |
| 延遲時間 - 傳輸： | 1.5ns |
| 輸出電流高，低： | 24mA，24mA |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 20-WQFN 裸露焊盤，20-DQFN |
| 供應(yīng)商設(shè)備封裝： | 20-DQFN |
| 包裝： | 帶卷 (TR) |
74LV4020_1
Koninklijke Philips Electronics N.V. 2005. All rights reserved.
Product data sheet
Rev. 01 — 29 November 2005
12 of 20
Philips Semiconductors
74LV4020
14-stage binary ripple counter
13. Waveforms
Measurement points: VM = 0.5 × VCC.
VOL and VOH are typical output voltage drop that occur with the output load.
Fig 7.
Propagation delay clock (CP) to output (Qn), clock pulse width and maximum clock
frequency
Measurement points: VM = 0.5 × VCC.
VOL and VOH are typical output voltage drop that occur with the output load.
Fig 8.
Propagation delay master reset (MR) to output (Qn), pulse width master reset (MR)
and removal time master reset (MR) to clock (CP)
001aad727
input CP, Qn
output Q0, Q(n+1)
tPHL
tPLH
tW
VOH
VI
GND
VOL
VM
1/fmax
001aad728
MR input
CP input
Qn output
tPHL
tW
trec
VM
VI
GND
VI
VOH
VOL
GND
VM
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PDF描述 |
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