參數資料
型號： 74HCT173
廠商： NXP Semiconductors N.V.
英文描述： Quad D-type flip-flop; positive-edge trigger; 3-state(四D觸發(fā)器；上升沿觸發(fā)；三態(tài))
中文描述： 四D型觸發(fā)器;陽性沿觸發(fā)，3態(tài)（四?觸發(fā)器，上升沿觸發(fā)，三態(tài)）
文件頁數： 10/10頁
文件大小： 69K
代理商： 74HCT173
December 1990
10
Philips Semiconductors
Product specification
Quad D-type flip-flop; positive-edge trigger;
3-state
74HC/HCT173
AC WAVEFORMS
Fig.6
Waveforms showing the clock (CP) to
output (Q
n
) propagation delays, the clock
pulse width, the output transition times and
the maximum clock pulse frequency.
(1) HC : V
M
= 50%; V
I
= GND to V
.
HCT: V
M
= 1.3 V; V
I
= GND to 3 V.
Fig.7
Waveforms showing the master reset (MR)
pulse width, the master reset to output (Q
n
)
propagation delays and the master reset to
clock (CP) removal time.
(1) HC : V
M
= 50%; V
I
= GND to V
.
HCT: V
M
= 1.3 V; V
I
= GND to 3 V.
Fig.8
Waveforms showing the 3-state enable and
disable times.
(1) HC : V
M
= 50%; V
I
= GND to V
.
HCT: V
M
= 1.3 V; V
I
= GND to 3 V.
PACKAGE OUTLINES
See
“74HC/HCT/HCU/HCMOS Logic Package Outlines”
.
Fig.9 Waveforms showing the data set-up and hold
times from input (En, D
n
) to clock (CP).
The shaded areas indicate when the input is permitted to
change for predictable output performance.
(1) HC : V
M
= 50%; V
I
= GND to V
.
HCT: V
M
= 1.3 V; V
I
= GND to 3 V.
相關PDF資料
PDF描述
74173 Quad D-type flip-flop; positive-edge trigger; 3-state
74HC173 Quad D-type flip-flop; positive-edge trigger; 3-state
74173 4-bit D-type Register (with 3-state Outputs)
74173 Quad 3-State D Flip-Flop with Common Clock and Reset
74HCT175 Quad D-type flip-flop with reset;positive-edge trigger(帶復位的四D觸發(fā)器；上升沿觸發(fā)；)
相關代理商/技術參數
參數描述
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