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參數(shù)資料
| 型號： | 74HC175 |
| 廠商： | NXP Semiconductors N.V. |
| 英文描述： | Quad D-type flip-flop with reset; positive-edge trigger |
| 中文描述： | 四D型觸發(fā)器的復位觸發(fā)器，積極邊緣觸發(fā) |
| 文件頁數(shù)： | 6/13頁 |
| 文件大?。?/td> | 103K |
| 代理商： | 74HC175 |
1998 Jul 08
6
Philips Semiconductors
Product specification
Quad D-type flip-flop with reset; positive-edge trigger
74HC/HCT175
DC CHARACTERISTICS FOR 74HCT
For the DC characteristics see
“74HC/HCT/HCU/HCMOS Logic Family Specifications”
.
Output capability: standard
I
CC
category: MSI
Note to HCT types
The value of additional quiescent supply current (
I
CC
) for a unit load of 1 is given in the family specifications.
To determine
I
CC
per input, multiply this value by the unit load coefficient shown in the table below.
AC CHARACTERISTICS FOR 74HCT
GND = 0 V; t
r
= t
f
= 6 ns; C
L
= 50 pF
INPUT
UNIT LOAD COEFFICIENT
MR
CP
D
n
1.00
0.60
0.40
SYMBOL
PARAMETER
T
amb
(
°
C)
UNIT
TEST CONDITIONS
74HCT
V
CC
(V)
WAVEFORMS
+
25
40 to
+
85
40 to
+
125
min.
typ.
max.
min.
max.
min.
max.
t
PHL
/ t
PLH
propagation delay
CP to Q
n
, Q
n
propagation delay
MR to Q
n
propagation delay
MR to Q
n
output transition time
19
33
41
50
ns
4.5
Fig.6
t
PHL
22
38
48
57
ns
4.5
Fig.8
t
PLH
19
35
44
53
ns
4.5
Fig.8
t
THL
/ t
TLH
7
15
19
22
ns
4.5
Fig.6
t
W
clock pulse width
HIGH or LOW
master reset pulse width
LOW
removal time
MR to CP
set-up time
D
n
to CP
hold time
CP to D
n
maximum clock pulse
frequency
20
12
25
30
ns
4.5
Fig.6
t
W
20
11
25
30
ns
4.5
Fig.8
t
rem
5
10
5
5
ns
4.5
Fig.8
t
su
16
5
20
24
ns
4.5
Fig.7
t
h
5
0
5
5
ns
4.5
Fig.7
f
max
25
49
20
17
MHz
4.5
Fig.6
相關PDF資料 |
PDF描述 |
|---|---|
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| 74HC181 | 4-bit arithmetic logic unit |
| 74HC181D | 4-bit arithmetic logic unit |
| 74HC181N | 4-bit arithmetic logic unit |
| 74HCT181 | 4-bit arithmetic logic unit |
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