參數(shù)資料
型號： 74ACT574SJX
廠商： FAIRCHILD SEMICONDUCTOR CORP
元件分類： 通用總線功能
英文描述： Octal D-Type Flip-Flop
中文描述： ACT SERIES, 8-BIT DRIVER, TRUE OUTPUT, PDSO20
封裝： 5.30 MM, LEAD FREE, EIAJ TYPE2, SOP-20
文件頁數(shù)： 4/9頁
文件大小： 100K
代理商： 74ACT574SJX
www.fairchildsemi.com
4
7
DC Electrical Characteristics for ACT
Note 5:
All outputs loaded; thresholds on input associated with output under test.
Note 6:
Maximum test duration 2.0 ms, one output loaded at a time.
AC Electrical Characteristics for AC
Note 7:
Voltage Range 3.3 is 3.3V
±
0.3V
Voltage Range 5.0 is 5.0V
±
0.5V
Symbol
Parameter
V
CC
(V)
4.5
5.5
4.5
T
A
=
25
°
C
Typ
1.5
1.5
1.5
T
A
=
40
°
C to
+
85
°
C
Guaranteed Limits
Units
Conditions
V
IH
Minimum HIGH Level
Input Voltage
Maximum LOW Level
2.0
2.0
0.8
2.0
2.0
0.8
V
V
OUT
=
0.1V
or V
CC
0.1V
V
OUT
=
0.1V
or V
CC
0.1V
V
IL
V
Input Voltage
Minimum HIGH Level
5.5
4.5
5.5
1.5
4.49
5.49
0.8
4.4
5.4
0.8
4.4
5.4
V
OH
V
I
OUT
=
50
μ
A
V
IN
=
V
IL
or V
IH
I
OH
=
24 mA
I
OH
=
24 mA (Note 5)
4.5
5.5
3.86
4.86
3.76
4.76
V
V
OL
Maximum LOW Level
Output Voltage
4.5
5.5
0.001
0.001
0.1
0.1
0.1
0.1
V
I
OUT
=
50
μ
A
V
IN
=
V
IL
or V
IH
I
OL
=
24 mA
I
OL
=
24 mA (Note 5)
4.5
5.5
0.36
0.36
0.44
0.44
V
I
IN
Maximum Input
5.5
±
0.1
±
1.0
μ
A
V
I
=
V
CC
, GND
Leakage Current
Maximum 3-STATE
Leakage Current
I
OZ
5.5
±
0.25
±
2.5
μ
A
V
I
=
V
IL
, V
IH
V
O
=
V
CC
, GND
V
I
=
V
CC
2.1V
V
OLD
=
1.65V
V
OHD
=
3.85V
V
IN
=
V
CC
or GND
I
CCT
I
]OLD
I
OHD
I
CC
Maximum I
CC
/Input
Minimum Dynamic
Output Current (Note 6)
5.5
5.5
5.5
0.6
1.5
75
75
mA
mA
mA
Maximum Quiescent
Supply Current
5.5
4.0
40.0
μ
A
V
CC
T
A
=
+
25
°
C
C
L
=
50 pF
Typ
112
153
T
A
=
40
°
C to
+
85
°
C
C
L
=
50 pF
Min
60
85
Symbol
Parameter
(V)
Units
(Note 7)
3.3
5.0
Min
75
95
Max
Max
f
MAX
Maximum Clock
Frequency
MHz
t
PLH
Propagation Delay
CP to O
n
Propagation Delay
3.3
5.0
3.3
3.5
2.0
3.5
8.5
6.0
7.5
13.5
9.5
12.0
3.5
2.0
3.5
15.0
11.0
13.5
ns
t
PHL
ns
CP to O
n
Output Enable Time
5.0
3.3
5.0
2.0
2.5
2.0
5.5
7.0
5.0
8.5
11.0
8.5
2.0
2.5
2.0
9.5
12.0
9.0
t
PZH
ns
t
PZL
Output Enable Time
3.3
5.0
3.3
3.0
2.0
3.5
6.5
5.0
7.5
10.5
8.0
12.0
3.0
1.5
2.5
11.5
9.0
13.0
ns
t
PHZ
Output Disable Time
ns
5.0
3.3
5.0
2.0
2.0
1.0
6.0
5.5
4.5
9.5
9.0
7.5
1.5
1.5
1.0
10.5
10.0
8.5
t
PLZ
Output Disable Time
ns
相關(guān)PDF資料
PDF描述
74ACT574 8-Bit LVTTL-GTLP Adjustable-Edge-Rate Registered Transceiver with Split LVTTL Port and Feedback Path 48-TSSOP -40 to 85
74AC574MTCX Octal D-Type Flip-Flop
74AC574SJX Octal D-Type Flip-Flop
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